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參數資料
| 型號： | TMX320C6413ZTSA500 |
| 廠商： | Texas Instruments, Inc. |
| 元件分類： | 數字信號處理 |
| 英文描述： | Fixed-Point Digital Signal Processors |
| 中文描述： | 定點數字信號處理器 |
| 文件頁數： | 106/140頁 |
| 文件大小： | 1958K |
| 代理商： | TMX320C6413ZTSA500 |
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Synchronous DRAM Timing
106
April 2004
Revised May 2005
SPRS247E
AECLKOUTx
ACEx
ABE[3:0]
AEA[12:3]
AED[31:0]
AAOE/ASDRAS/ASOE
AARE/ASDCAS/ASADS/
ASRE
AAWE/ASDWE/ASWE
AEA13
AEA[22:14]
BE1
BE2
BE3
BE4
Bank
Column
D1
D2
D3
D4
11
8
9
5
5
5
4
2
11
8
9
4
4
2
1
10
3
4
WRITE
PDT
14
14
AARE/ASDCAS/ASADS/ASRE, AAWE/ASDWE/ASWE, and AAOE/ASDRAS/ASOE operate as AsDCAS, ASDWE, and ASDRAS, respectively,
during SDRAM accesses.
PDT signal is only asserted when the EDMA is in PDT mode (set the PDTD bit to 1 in the EDMA options parameter RAM). For PDT write, data
is not driven (in High-Z). The PDTWL field in the PDT control register (PDTCTL) configures the latency of the PDT signal with respect to the data
phase of a write transaction. The latency of the PDT signal for a write transaction can be programmed to 0, 1, 2, or 3 by setting PDTWL to 00,
01, 10, or 11, respectively. PDTWL equals 00 (zero latency) in Figure 7
13.
Figure 7
13. SDRAM Write Command for EMIFA
相關PDF資料 |
PDF描述 |
|---|---|
| TMX320C6413ZTS400 | Fixed-Point Digital Signal Processors |
| TMP320C6413ZTS400 | Fixed-Point Digital Signal Processors |
| TMX320C6413ZTS500 | Fixed-Point Digital Signal Processors |
| TMP320C6413ZTS500 | Fixed-Point Digital Signal Processors |
| TMX320C6413ZTSA400 | Fixed-Point Digital Signal Processors |
相關代理商/技術參數 |
參數描述 |
|---|---|
| TMX320C6414CGLZ300 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:FIXED-POINT DIGITAL SIGNAL PROCESSORS |
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| TMX320C6414CGLZ5E0 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:FIXED-POINT DIGITAL SIGNAL PROCESSORS |
| TMX320C6414CGLZA300 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:FIXED-POINT DIGITAL SIGNAL PROCESSORS |
| TMX320C6414CGLZA5E0 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:FIXED-POINT DIGITAL SIGNAL PROCESSORS |
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