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參數資料
| 型號： | 71M6541F-IGT/F |
| 廠商： | MAXIM INTEGRATED PRODUCTS INC |
| 元件分類： | 模擬信號調理 |
| 英文描述： | SPECIALTY ANALOG CIRCUIT, PQFP64 |
| 封裝： | LEAD FREE, LQFP-64 |
| 文件頁數： | 51/165頁 |
| 文件大小： | 2208K |
| 代理商： | 71M6541F-IGT/F |
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144
2008–2011 Teridian Semiconductor Corporation
v1.1
6.4.9
2.5 V Voltage Regulator – Battery Power
Unless otherwise specified, V3P3SYS = V3P3A = 0, PB=GND (BRN).
Table 104: Low-Power Voltage Regulator Performance Specifications
Parameter
Condition
Min
Typ
Max
Unit
V2P5
VBAT = 3.0 V - 3.8 V,
V3P3 = 0 V, ILOAD = 0 mA
2.55
2.65
2.75
V
V2P5 load regulation
VBAT = 3.3 V, V3P3 = 0 V,
ILOAD = 0 mA to 1 mA
40
mV
Voltage Overhead 2V
VBAT-VDD
ILOAD = 0ma, VBAT = 2.0 V,
V3P3 = 0 V.
200
mV
6.4.10 Crystal Oscillator
Measurement conditions: Crystal disconnected, test load of 200 pF/100 k
Ω between XOUT and GNDD.
Table 105: Crystal Oscillator Performance Specifications
Parameter
Condition
Min
Typ
Max
Unit
Maximum Output Power to Crystal
Crystal connected, see note 1
1
μW
XIN to XOUT Capacitance
(see note 1)
3
pF
Capacitance change on XOUT
RTC_ADJ = 7F to 0,
Bias voltage = unbiased
Vpp = 0.1 V
15
pF
Note:
1.
Guaranteed by design; not production tested.
6.4.11 Phase-Locked Loop (PLL)
Table 106: PLL Performance Specifications
Parameter
Condition
Min
Typ
Max
Unit
PLL Power up Settling Time
(see note 1)
PLL_FAST = 0, V3P3 = 0 V to 3.3 V
step, measured from first edge of
MCK
5
ms
PLL_FAST settling time
PLL_FAST rise (see note 1)
PLL_FAST fall (see note 1)
V3P3 = 0 V, VBAT = 3.8 V to 2.0 V
5
ms
PLL SLP to MSN Settling Time
(see note 1)
PLL_FAST = 0
5
ms
PLL power up overshoot
(see note 1)
PLL_FAST = 0
2.5
MHz
Note:
1.
Guaranteed by design; not production tested.
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
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