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參數資料
| 型號： | 73S1215F-EB-LITE |
| 廠商： | Maxim Integrated Products |
| 文件頁數： | 11/136頁 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL 73S1215F CBL/DOC/CD |
| 產品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 1 |
| 系列： | * |
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73S1215F Data Sheet
DS_1215F_003
108
Rev. 1.4
ATR Timeout Registers (ATRLsB): 0xFE20
0x00, (ATRMsB): 0xFE1F
0x00
Table 113: The ATRLsB Register
MSB
LSB
ATRTO.7
ATRTO.6
ATRTO.5
ATRTO.4
ATRTO.3
ATRTO.1 ATRTO.2 ATRTO.0
Table 114: The ATRMsB Register
MSB
LSB
ATRTO.15 ATRTO.14 ATRTO.13 ATRTO.12 ATRTO.11 ATRTO.10 ATRTO.9 ATRTO.8
These registers (ATRLsB and ATRLsB) form the ATR timeout (ATRTO [15:0]) parameter. Time in ETU
between the leading edge of the first character and leading edge of the last character of the ATR
response. Timer is enabled when the RCVATR is set and starts when leading edge of the first start bit is
received and disabled when the RCVATR is cleared. An ATR timeout is generated if this time is
exceeded.
TS Timeout Register (STSTO): 0xFE21
0x00
Table 115: The STSTO Register
MSB
LSB
TST0.7
TST0.6
TST0.5
TST0.4
TST0.3
TST0.1
TST0.2
TST0.0
The TS timeout is the time in ETU between the de-assertion of smart card reset and the leading edge of
the TS character in the ATR (when DETTS is set). The timer is started when smart card reset is
de-asserted. An ATR timeout is generated if this time is exceeded (MUTE card).
Reset Time Register (RLength): 0xFE22
0x70
Table 116: The RLength Register
MSB
LSB
RLen.7
RLen.6
RLen.5
RLen.4
RLen.3
RLen.1
RLen.2
RLen.0
Time in ETUs that the hardware delays the de-assertion of RST. If set to zero and RSTCRD = 0, the
hardware adds no extra delay and the hardware will release RST after VCCOK is asserted during
power-up. If set to one, it will delay the release of RST by the time in this register. When the firmware
sets the RSTCRD bit, the hardware will assert reset (RST = 0 on pin). When firmware clears the bit, the
hardware will release RST after the delay specified in Rlen. If firmware sets the RSTCRD bit prior to
instructing the power to be applied to the smart card, the hardware will not release RST after power-up
until RLen after the firmware clears the RSTCRD bit. This provides a means to power up the smart card
and hold it in reset until the firmware wants to release the RST to the selected smart card. Works with
the selected smart card interface.
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PDF描述 |
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參數描述 |
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| 73S1217F-68IM/F | 功能描述:8位微控制器 -MCU Bus Pwr’d 80515 SoC w/USB 7816/EMV PINpd RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數據總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數據 RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
| 73S1217F-68IM/F/P | 功能描述:IC SMART CARD READER PROG 68-QFN RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微控制器， 系列:73S12xx 產品培訓模塊:MCU Product Line Introduction AVR® UC3 Introduction 標準包裝:2,500 系列:AVR®32 UC3 B 核心處理器:AVR 芯體尺寸:32-位 速度:60MHz 連通性:I²C，IrDA，SPI，SSC，UART/USART，USB 外圍設備:欠壓檢測/復位，DMA，POR，PWM，WDT 輸入/輸出數:28 程序存儲器容量:128KB（128K x 8） 程序存儲器類型:閃存 EEPROM 大小:- RAM 容量:32K x 8 電壓 - 電源 (Vcc/Vdd):1.65 V ~ 1.95 V 數據轉換器:A/D 6x10b 振蕩器型:內部 工作溫度:-40°C ~ 85°C 封裝/外殼:48-TQFP 包裝:帶卷 (TR) 配用:ATSTK600-TQFP48-ND - STK600 SOCKET/ADAPTER 48-TQFPATAVRONEKIT-ND - KIT AVR/AVR32 DEBUGGER/PROGRMMRATEVK1101-ND - KIT DEV/EVAL FOR AVR32 AT32UC3B 其它名稱:AT32UC3B1128-AUR-NDAT32UC3B1128-AURTR |
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