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參數(shù)資料
| 型號(hào)： | 74AHC74D,112 |
| 廠商： | NXP Semiconductors |
| 文件頁(yè)數(shù)： | 1/14頁(yè) |
| 文件大小： | 0K |
| 描述： | IC DUAL D F-F POS-EDGE 14SOIC |
| 產(chǎn)品培訓(xùn)模塊： | Logic Packages |
| 標(biāo)準(zhǔn)包裝： | 1,140 |
| 系列： | 74AHC |
| 功能： | 設(shè)置（預(yù)設(shè)）和復(fù)位 |
| 類型： | D 型 |
| 輸出類型： | 差分 |
| 元件數(shù)： | 2 |
| 每個(gè)元件的位元數(shù)： | 1 |
| 頻率 - 時(shí)鐘： | 75MHz |
| 延遲時(shí)間 - 傳輸： | 7.4ns |
| 觸發(fā)器類型： | 正邊沿 |
| 輸出電流高，低： | 8mA，8mA |
| 電源電壓： | 2 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 14-SOIC（0.154"，3.90mm 寬） |
| 包裝： | 管件 |
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1.
General description
The 74AHC74; 74AHCT74 is a high-speed Si-gate CMOS device and is pin compatible
with Low-Power Schottky TTL (LSTTL). It is specied in compliance with JEDEC standard
No. 7-A.
The 74AHC74; 74AHCT74 is a dual positive-edge triggered, D-type ip-op with individual
data inputs (D), clock inputs (CP), set inputs (SD) and reset inputs (RD). It also has
complementary outputs (Q and Q).
The set and reset are asynchronous active LOW inputs that operate independent of the
clock input. Information on the data input is transferred to the Q output on the LOW to
HIGH transition of the clock pulse. The data inputs must be stable one set-up time prior to
the LOW to HIGH clock transition for predictable operation.
Schmitt-trigger action in the clock input makes the circuit highly tolerant to slower clock
rise and fall times.
2.
Features
I Balanced propagation delays
I All inputs have Schmitt-trigger actions
I Inputs accept voltages higher than VCC
I Input levels:
N For 74AHC74: CMOS level
N For 74AHCT74: TTL level
I ESD protection:
N HBM EIA/JESD22-A114E exceeds 2000 V
N MM EIA/JESD22-A115-A exceeds 200 V
N CDM EIA/JESD22-C101C exceeds 1000 V
I Multiple package options
I Specied from 40 °C to +85 °C and from 40 °C to +125 °C
74AHC74; 74AHCT74
Dual D-type ip-op with set and reset; positive-edge trigger
Rev. 05 — 9 June 2008
Product data sheet
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 74AHCT1G79GW,125 | IC D F-F POS-EDGE TRIG SC88A-5 |
| 74ALVC16835DLRG4 | IC UNIV BUS DVR 18BIT 56SSOP |
| 74ALVCH162244DGG:5 | IC BUFF DVR TRI-ST 16BIT 48TSSOP |
| 74ALVCH162245DGG:5 | IC TRANSCVR 16BIT N-INV 48TSSOP |
| 74ALVCH16245DGG:51 | IC TRANSCVR 3-ST 16BIT 48TSSOP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 74AHC74D-Q100J | 制造商:NXP Semiconductors 功能描述:74AHC74D-Q100/SO14/REEL13// 制造商:NXP Semiconductors 功能描述:Flip Flop D-Type Pos-Edge 2-Element 14-Pin SO T/R 制造商:NXP Semiconductors 功能描述:74AHC74D-Q100/SO14/REEL13// - Tape and Reel 制造商:NXP Semiconductors 功能描述:IC FLIP-FLOP SET/RESET 14SOIC |
| 74AHC74PW | 功能描述:觸發(fā)器 DUAL D-TYPE FLIPFLOP RoHS:否 制造商:Texas Instruments 電路數(shù)量:2 邏輯系列:SN74 邏輯類型:D-Type Flip-Flop 極性:Inverting, Non-Inverting 輸入類型:CMOS 輸出類型: 傳播延遲時(shí)間:4.4 ns 高電平輸出電流:- 16 mA 低電平輸出電流:16 mA 電源電壓-最大:5.5 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:X2SON-8 封裝:Reel |
| 74AHC74PW,112 | 功能描述:觸發(fā)器 DUAL D-TYPE FLIPFLOP RoHS:否 制造商:Texas Instruments 電路數(shù)量:2 邏輯系列:SN74 邏輯類型:D-Type Flip-Flop 極性:Inverting, Non-Inverting 輸入類型:CMOS 輸出類型: 傳播延遲時(shí)間:4.4 ns 高電平輸出電流:- 16 mA 低電平輸出電流:16 mA 電源電壓-最大:5.5 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:X2SON-8 封裝:Reel |
| 74AHC74PW,118 | 功能描述:觸發(fā)器 DUAL D-TYPE FLIPFLOP RoHS:否 制造商:Texas Instruments 電路數(shù)量:2 邏輯系列:SN74 邏輯類型:D-Type Flip-Flop 極性:Inverting, Non-Inverting 輸入類型:CMOS 輸出類型: 傳播延遲時(shí)間:4.4 ns 高電平輸出電流:- 16 mA 低電平輸出電流:16 mA 電源電壓-最大:5.5 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:X2SON-8 封裝:Reel |
| 74AHC74PW/AUJ | 制造商:NXP Semiconductors 功能描述:74AHC74PW/TSSOP14/REEL13//AU - Tape and Reel 制造商:NXP Semiconductors 功能描述:IC FLIP-FLOP DUAL D POS 14TSSOP |
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