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參數(shù)資料
| 型號： | 74AUP1G3208GW,125 |
| 廠商： | NXP Semiconductors |
| 文件頁數(shù)： | 1/19頁 |
| 文件大小： | 0K |
| 描述： | IC 3-IN OR-AND GATE LP SC-88 |
| 產(chǎn)品培訓(xùn)模塊： | Logic Packages |
| 標準包裝： | 3,000 |
| 系列： | 74AUP |
| 邏輯類型： | 與/或門 |
| 電路數(shù)： | 1 |
| 輸入數(shù)： | 3 輸入（2，1） |
| 施密特觸發(fā)器輸入： | 是 |
| 輸出類型： | 單端 |
| 輸出電流高，低： | 4mA，4mA |
| 電源電壓： | 0.8 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 6-TSSOP，SC-88，SOT-363 |
| 供應(yīng)商設(shè)備封裝： | 6-TSSOP |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 74AUP1G3208GW-G 74AUP1G3208GW-G-ND 935280616125 |
1.
General description
The 74AUP1G3208 provides the Boolean function: Y = (A + B)
× C. The user can choose
the logic functions OR, AND and OR-AND. All inputs can be connected to VCC or GND.
Schmitt trigger action at all inputs makes the circuit tolerant to slower input rise and fall
times across the entire VCC range from 0.8 V to 3.6 V.
This device ensures a very low static and dynamic power consumption across the entire
VCC range from 0.8 V to 3.6 V.
This device is fully specified for partial power-down applications using IOFF.
The IOFF circuitry disables the output, preventing the damaging backflow current through
the device when it is powered down.
2.
Features and benefits
Wide supply voltage range from 0.8 V to 3.6 V
High noise immunity
Complies with JEDEC standards:
JESD8-12 (0.8 V to 1.3 V)
JESD8-11 (0.9 V to 1.65 V)
JESD8-7 (1.2 V to 1.95 V)
JESD8-5 (1.8 V to 2.7 V)
JESD8-B (2.7 V to 3.6 V)
ESD protection:
HBM JESD22-A114F Class 3A exceeds 5000 V
MM JESD22-A115-A exceeds 200 V
CDM JESD22-C101E exceeds 1000 V
Low static power consumption; ICC = 0.9
μA (maximum)
Latch-up performance exceeds 100 mA per JESD 78 Class II
Inputs accept voltages up to 3.6 V
Low noise overshoot and undershoot < 10 % of VCC
IOFF circuitry provides partial Power-down mode operation
Multiple package options
Specified from
40 °Cto+85 °C and 40 °Cto+125 °C
74AUP1G3208
Low-power 3-input OR-AND gate
Rev. 5 — 22 June 2012
Product data sheet
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TXR41AB00-1006AI | ADPTR TINEL LOCK STR SHELL 10,11 |
| 74AUP1G57GW,125 | IC CONFIG MULTI-FUNC GATE SC-88 |
| TXR40AB00-1210AI | ADPTR TINEL LOCK STR SHELL 13, C |
| TXR51AB00-0804AI | ADPTR TINEL LOCK STR SHELL 8 |
| TXR76AB00-1604AI | ADPTR TINEL LOCK STR SHELL 16 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 74AUP1G3208GW-G | 功能描述:邏輯門 1.8V SINGLE SCHMITT TRIG BUF RoHS:否 制造商:Texas Instruments 產(chǎn)品:OR 邏輯系列:LVC 柵極數(shù)量:2 線路數(shù)量（輸入/輸出）:2 / 1 高電平輸出電流:- 16 mA 低電平輸出電流:16 mA 傳播延遲時間:3.8 ns 電源電壓-最大:5.5 V 電源電壓-最小:1.65 V 最大工作溫度:+ 125 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DCU-8 封裝:Reel |
| 74AUP1G3208GXZ | 功能描述:74AUP1G3208GX/SOT1255/X2SON6 制造商:nexperia usa inc. 系列:* 零件狀態(tài):在售 標準包裝:10,000 |
| 74AUP1G32FS3-7 | 功能描述:OR Gate IC 1 Channel 4-X2DFN (0.80x0.80) 制造商:diodes incorporated 系列:74AUP 包裝:剪切帶（CT） 零件狀態(tài):有效 邏輯類型:或門 電路數(shù):1 輸入數(shù):2 特性:- 電壓 - 電源:0.8 V ~ 3.6 V 電流 - 靜態(tài)（最大值）:0.5μA 電流 - 輸出高，低:4mA，4mA 邏輯電平 - 低:0.7 V ~ 0.9 V 邏輯電平 - 高:1.6 V ~ 2 V 不同 V，最大 CL 時的最大傳播延遲:6.4ns @ 3.3V，30pF 工作溫度:-40°C ~ 125°C 安裝類型:表面貼裝 供應(yīng)商器件封裝:4-X2DFN（0.80x0.80） 封裝/外殼:4-XFDFN 裸露焊盤 標準包裝:1 |
| 74AUP1G32FW4-7 | 功能描述:邏輯門 Single 2Input POS OR 6.3pF 0.8 to 2.6 AUP RoHS:否 制造商:Texas Instruments 產(chǎn)品:OR 邏輯系列:LVC 柵極數(shù)量:2 線路數(shù)量（輸入/輸出）:2 / 1 高電平輸出電流:- 16 mA 低電平輸出電流:16 mA 傳播延遲時間:3.8 ns 電源電壓-最大:5.5 V 電源電壓-最小:1.65 V 最大工作溫度:+ 125 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DCU-8 封裝:Reel |
| 74AUP1G32FW5-7 | 功能描述:OR Gate IC 1 Channel X1-DFN1010-6 制造商:diodes incorporated 系列:74AUP 包裝:剪切帶（CT） 零件狀態(tài):有效 邏輯類型:或門 電路數(shù):1 輸入數(shù):2 特性:- 電壓 - 電源:0.8 V ~ 3.6 V 電流 - 靜態(tài)（最大值）:0.5μA 電流 - 輸出高，低:4mA，4mA 邏輯電平 - 低:0.7 V ~ 0.9 V 邏輯電平 - 高:1.6 V ~ 2 V 不同 V，最大 CL 時的最大傳播延遲:6.4ns @ 3.3V，30pF 工作溫度:-40°C ~ 125°C 安裝類型:表面貼裝 供應(yīng)商器件封裝:X1-DFN1010-6 封裝/外殼:6-XDFN 標準包裝:1 |
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