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參數(shù)資料
| 型號： | 74LVC2G74GT,115 |
| 廠商： | NXP Semiconductors |
| 文件頁數(shù)： | 1/20頁 |
| 文件大小： | 0K |
| 描述： | IC SNGL D FF POS-EDG TRIG 8XSON |
| 產(chǎn)品培訓(xùn)模塊： | Logic Packages |
| 特色產(chǎn)品： | MicroPak? |
| 標(biāo)準(zhǔn)包裝： | 5,000 |
| 系列： | 74LVC |
| 功能： | 設(shè)置（預(yù)設(shè)）和復(fù)位 |
| 類型： | D 型 |
| 輸出類型： | 差分 |
| 元件數(shù)： | 1 |
| 每個元件的位元數(shù)： | 1 |
| 頻率 - 時鐘： | 200MHz |
| 延遲時間 - 傳輸： | 2.5ns |
| 觸發(fā)器類型： | 正邊沿 |
| 輸出電流高，低： | 32mA，32mA |
| 電源電壓： | 1.65 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 8-XFDFN |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 568-9356-2 74LVC2G74GT,115-ND 74LVC2G74GT-G 74LVC2G74GT-G-ND 935280389115 |
1.
General description
The 74LVC2G74 is a single positive-edge triggered D-type flip-flop with individual data (D)
inputs, clock (CP) inputs, set (SD) and reset (RD) inputs, and complementary Q and Q
outputs.
This device is fully specified for partial power-down applications using IOFF. The IOFF
circuitry disables the output, preventing damaging backflow current through the device
when it is powered down.
The set and reset are asynchronous active LOW inputs and operate independently of the
clock input. Information on the data input is transferred to the Q output on the
LOW-to-HIGH transition of the clock pulse. The D inputs must be stable, one set-up time
prior to the LOW-to-HIGH clock transition for predictable operation.
Schmitt-trigger action at all inputs makes the circuit highly tolerant of slower input rise and
fall times.
2.
Features and benefits
Wide supply voltage range from 1.65 V to 5.5 V
5 V tolerant inputs for interfacing with 5 V logic
High noise immunity
Complies with JEDEC standard:
JESD8-7 (1.65 V to 1.95 V)
JESD8-5 (2.3 V to 2.7 V)
JESD8-B/JESD36 (2.7 V to 3.6 V)
24 mA output drive (V
CC =3.0 V)
ESD protection:
HBM JESD22-A114F exceeds 2000 V
MM JESD22-A115-A exceeds 200 V
CMOS low power consumption
Latch-up performance exceeds 250 mA
Direct interface with TTL levels
Inputs accept voltages up to 5 V
Multiple package options
Specified from
40 Cto+85 C and 40 Cto+125 C
74LVC2G74
Single D-type flip-flop with set and reset; positive edge trigger
Rev. 10 — 2 April 2013
Product data sheet
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 74AHC74BQ,115 | IC DUAL D F-F POS-EDGE 14DHVQFN |
| 788188-1 | CONN PLUG CPC HSING 17-3 REV |
| 208488-4 | CONN PLUG 16POS STANDARD CMC |
| 74HC112N,652 | IC DUAL JK F-F NEG-EDGE 16DIP |
| M85049/1815W02 | BACKSHELL EMI RFI SZ 15 CADMIUM |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 74LVC2G74GT-G | 功能描述:觸發(fā)器 SNGL D-TYPE POSITIVE RoHS:否 制造商:Texas Instruments 電路數(shù)量:2 邏輯系列:SN74 邏輯類型:D-Type Flip-Flop 極性:Inverting, Non-Inverting 輸入類型:CMOS 輸出類型: 傳播延遲時間:4.4 ns 高電平輸出電流:- 16 mA 低電平輸出電流:16 mA 電源電壓-最大:5.5 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:X2SON-8 封裝:Reel |
| 74LVC2G86DC,125 | 功能描述:邏輯門 DUAL 2-IN EX-OR GATE RoHS:否 制造商:Texas Instruments 產(chǎn)品:OR 邏輯系列:LVC 柵極數(shù)量:2 線路數(shù)量（輸入/輸出）:2 / 1 高電平輸出電流:- 16 mA 低電平輸出電流:16 mA 傳播延遲時間:3.8 ns 電源電壓-最大:5.5 V 電源電壓-最小:1.65 V 最大工作溫度:+ 125 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DCU-8 封裝:Reel |
| 74LVC2G86DC-G | 功能描述:邏輯門 DUAL 2-IN EX-OR GATE RoHS:否 制造商:Texas Instruments 產(chǎn)品:OR 邏輯系列:LVC 柵極數(shù)量:2 線路數(shù)量（輸入/輸出）:2 / 1 高電平輸出電流:- 16 mA 低電平輸出電流:16 mA 傳播延遲時間:3.8 ns 電源電壓-最大:5.5 V 電源電壓-最小:1.65 V 最大工作溫度:+ 125 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DCU-8 封裝:Reel |
| 74LVC2G86DC-Q100H | 制造商:NXP Semiconductors 功能描述:74LVC2G86DC-Q100/VSSOP8/REELR/ - Tape and Reel 制造商:NXP Semiconductors 功能描述:IC GATE XOR DUAL 2-INPUT 8VSSOP |
| 74LVC2G86DP,125 | 功能描述:邏輯門 3.3V DUAL 2-INPUT RoHS:否 制造商:Texas Instruments 產(chǎn)品:OR 邏輯系列:LVC 柵極數(shù)量:2 線路數(shù)量（輸入/輸出）:2 / 1 高電平輸出電流:- 16 mA 低電平輸出電流:16 mA 傳播延遲時間:3.8 ns 電源電壓-最大:5.5 V 電源電壓-最小:1.65 V 最大工作溫度:+ 125 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:DCU-8 封裝:Reel |
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