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參數資料
| 型號： | 74LVX86 |
| 廠商： | 意法半導體 |
| 英文描述： | Low Voltage CMOS Quad Exclusive or Gate(低壓四異或門) |
| 中文描述： | 低電壓的CMOS四異或門（低壓四異或門） |
| 文件頁數： | 1/8頁 |
| 文件大小： | 62K |
| 代理商： | 74LVX86 |
74LVX86
LOW VOLTAGE CMOS QUAD EXCLUSIVE OR GATE
November 1998
I
HIGHSPEED:t
PD
=5.8ns(TYP.)atV
CC
= 3.3V
I
INPUTVOLTAGELEVEL:
V
IL
=0.8V,V
IH
=2V atV
CC
=3V
I
LOWPOWERDISSIPATION:
I
CC
=2
μ
A(MAX.) at T
A
=25
o
C
I
LOWNOISE:
V
OLP
=0.3V (TYP.)at V
CC
= 3.3V
I
SYMMETRICALOUTPUTIMPEDANCE:
|I
OH
| = I
OL
= 4 mA(MIN)
I
BALANCEDPROPAGATIONDELAYS:
t
PLH
t
PHL
I
OPERATINGVOLTAGERANGE:
V
CC
(OPR)= 2Vto 3.6V(1.2VDataRetention)
I
PINANDFUNCTION COMPATIBLEWITH
74SERIES86
I
IMPROVEDLATCH-UP IMMUNITY
DESCRIPTION
The 74LVX86 is a low voltage CMOS QUAD
EXCLUSIVE
OR
GATE
sub-micron silicon gate and double-layer metal
wiring C
2
MOS technology. It is ideal for low
fabricated
with
power and low noise 3.3Vapplications.
It has better speed performance at 3.3V than 5V
LS-TTL family combined with the true CMOS low
power consumption.
All
inputs
and
outputs are
protection circuits against static discharge, giving
them 2KV ESD immunity and transient excess
voltage.
equipped with
PIN CONNECTION AND IEC LOGIC SYMBOLS
ORDER CODES :
74LVX86M
74LVX86T
M
(Micro Package)
T
(TSSOPPackage)
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PDF描述 |
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