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參數(shù)資料
型號： A3PN125-VQG100I
元件分類： FPGA
英文描述： FPGA, 3072 CLBS, 125000 GATES, PQFP100
封裝： 14 X 14 MM, 1.20 MM HEIGHT, 0.50 MM PITCH, ROHS COMPLIANT, VQFP-100
文件頁數(shù)： 44/106頁
文件大小： 3324K
代理商： A3PN125-VQG100I
ProASIC3 nano DC and Switching Characteristics
2- 28
R e visio n 8
Table 2-36 3.3 V LVCMOS Wide Range Low Slew
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.425 V, Worst-Case VCCI = 2.7 V
Software Default Load at 35 pF for A3PN020, A3PN015, A3PN010
Drive
Strength
Equivalent
Software
Default
Drive
Strength
Option1
Speed
Grade
tDOUT
tDP
tDIN
tPY
tPYS
tEOUT
tZL
tZH
tLZ
tHZ
Units
100 A
2 mA
Std.
0.60
8.20
0.04
1.57
2.18
0.43
8.20
7.68
3.26
3.38
ns
–1
0.51
6.97
0.04
1.33
1.85
0.36
6.97
6.53
2.77
2.87
ns
–2
0.45
6.12
0.03
1.17
1.62
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6.12
5.73
2.43
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4.79
4.52
2.78
3.11
ns
Notes:
1. Note that 3.3 V LVCMOS wide range is applicable to 100 A drive strength only. The configuration will not operate at the
equivalent software default drive strength. These values are for normal ranges only.
2. For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-5 for derating values.
相關(guān)PDF資料
PDF描述
A3PN125-VQG100 FPGA, 3072 CLBS, 125000 GATES, PQFP100
A3PN125-Z1VQ100I FPGA, 3072 CLBS, 125000 GATES, PQFP100
A3PN125-Z1VQ100 FPGA, 3072 CLBS, 125000 GATES, PQFP100
A3PN125-Z1VQG100I FPGA, 3072 CLBS, 125000 GATES, PQFP100
A3PN125-Z1VQG100 FPGA, 3072 CLBS, 125000 GATES, PQFP100
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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