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參數(shù)資料
| 型號(hào)： | A3PN125-Z2VQ100I |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 3072 CLBS, 125000 GATES, PQFP100 |
| 封裝： | 14 X 14 MM, 1.20 MM HEIGHT, 0.50 MM PITCH, VQFP-100 |
| 文件頁(yè)數(shù)： | 30/100頁(yè) |
| 文件大小： | 3284K |
| 代理商： | A3PN125-Z2VQ100I |
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ProASIC3 nano DC and Switching Characteristics
Ad vance v0.2
2-21
Timing Characteristics
Table 2-29 3.3 V LVTTL / 3.3 V LVCMOS Low Slew
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.425 V, Worst-Case VCCI = 3.0 V
Software Default Load at 35 pF for A3PN060, A3PN125, A3PN250
Drive
Strength
Speed
Grade
tDOUT
tDP
tDIN
tPY
tPYS
tEOUT
tZL
tZH
tLZ
tHZ
Units
2 mA
Std.
0.60
10.48
0.04
1.12
TBD
0.43
8.86
7.41
2.40
2.47
ns
–1
0.51
8.91
0.04
0.95
TBD
0.36
7.54
6.30
2.04
2.10
ns
–2
0.45
7.83
0.03
0.84
TBD
0.32
6.62
5.53
1.79
1.84
ns
4 mA
Std.
0.60
10.48
0.04
1.12
TBD
0.43
8.86
7.41
2.40
2.47
ns
–1
0.51
8.91
0.04
0.95
TBD
0.36
7.54
6.30
2.04
2.10
ns
–2
0.45
7.83
0.03
0.84
TBD
0.32
6.62
5.53
1.79
1.84
ns
6 mA
Std.
0.60
7.45
0.04
1.12
TBD
0.43
6.48
5.53
2.69
3.00
ns
–1
0.51
6.33
0.04
0.95
TBD
0.36
5.51
4.70
2.29
2.55
ns
–2
0.45
5.56
0.03
0.84
TBD
0.32
4.84
4.13
2.01
2.24
ns
8 mA
Std.
0.60
7.45
0.04
1.12
TBD
0.43
6.48
5.53
2.69
3.00
ns
–1
0.51
6.33
0.04
0.95
TBD
0.36
5.51
4.70
2.29
2.55
ns
–2
0.45
5.56
0.03
0.84
TBD
0.32
4.84
4.13
2.01
2.24
ns
Note: For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-5 for derating
values.
Table 2-30 3.3 V LVTTL / 3.3 V LVCMOS High Slew
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.425 V, Worst-Case VCCI = 3.0 V
Software Default Load at 35 pF for A3PN060, A3PN125, A3PN250
Drive
Strength
Speed
Grade
tDOUT
tDP
tDIN
tPY
tPYS
tEOUT
tZL
tZH
tLZ
tHZ
Units
2 mA
Std.
0.60
7.53
0.04
1.12
TBD
0.43
6.15
5.18
2.39
2.61
ns
–1
0.51
6.41
0.04
0.95
TBD
0.36
5.23
4.41
2.04
2.22
ns
–2
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0.03
0.84
TBD
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4.60
3.87
1.79
1.95
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4 mA
Std.
0.60
7.53
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TBD
0.43
6.15
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ns
–1
0.51
6.41
0.04
0.95
TBD
0.36
5.23
4.41
2.04
2.22
ns
–2
0.45
5.63
0.03
0.84
TBD
0.32
4.60
3.87
1.79
1.95
ns
6 mA
Std.
0.60
4.85
0.04
1.12
TBD
0.43
4.17
3.40
2.69
3.14
ns
–1
0.51
4.13
0.04
0.95
TBD
0.36
3.55
2.89
2.29
2.67
ns
–2
0.45
3.63
0.03
0.84
TBD
0.32
3.11
2.54
2.01
2.34
ns
8 mA
Std.
0.60
4.85
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1.12
TBD
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3.40
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0.51
4.13
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TBD
0.36
3.55
2.89
2.29
2.67
ns
–2
0.45
3.63
0.03
0.84
TBD
0.32
3.11
2.54
2.01
2.34
ns
Notes:
1. Software default selection highlighted in gray.
2. For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-5 for derating
values.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| A3PN125-Z2VQ100 | FPGA, 3072 CLBS, 125000 GATES, PQFP100 |
| A3PN125-Z2VQG100I | FPGA, 3072 CLBS, 125000 GATES, PQFP100 |
| A3PN125-Z2VQG100 | FPGA, 3072 CLBS, 125000 GATES, PQFP100 |
| A3PN125-ZVQ100I | FPGA, 3072 CLBS, 125000 GATES, PQFP100 |
| A3PN125-ZVQ100 | FPGA, 3072 CLBS, 125000 GATES, PQFP100 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| A3PN125-Z2VQG100I | 功能描述:IC FPGA NANO 125K GATES 100-VQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:ProASIC3 nano 標(biāo)準(zhǔn)包裝:152 系列:IGLOO PLUS LAB/CLB數(shù):- 邏輯元件/單元數(shù):792 RAM 位總計(jì):- 輸入/輸出數(shù):120 門數(shù):30000 電源電壓:1.14 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 85°C 封裝/外殼:289-TFBGA，CSBGA 供應(yīng)商設(shè)備封裝:289-CSP（14x14） |
| A3PN125-ZVQ100 | 功能描述:IC FPGA NANO 125K GATES 100-VQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:ProASIC3 nano 標(biāo)準(zhǔn)包裝:152 系列:IGLOO PLUS LAB/CLB數(shù):- 邏輯元件/單元數(shù):792 RAM 位總計(jì):- 輸入/輸出數(shù):120 門數(shù):30000 電源電壓:1.14 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 85°C 封裝/外殼:289-TFBGA，CSBGA 供應(yīng)商設(shè)備封裝:289-CSP（14x14） |
| A3PN125-ZVQ100I | 功能描述:IC FPGA NANO 125K GATES 100-VQFP RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:ProASIC3 nano 標(biāo)準(zhǔn)包裝:152 系列:IGLOO PLUS LAB/CLB數(shù):- 邏輯元件/單元數(shù):792 RAM 位總計(jì):- 輸入/輸出數(shù):120 門數(shù):30000 電源電壓:1.14 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 85°C 封裝/外殼:289-TFBGA，CSBGA 供應(yīng)商設(shè)備封裝:289-CSP（14x14） |
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