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參數(shù)資料
| 型號(hào)： | A40MX04-PL68I |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 547 CLBS, 6000 GATES, 80 MHz, PQCC68 |
| 封裝： | PLASTIC, LCC-68 |
| 文件頁數(shù)： | 39/124頁 |
| 文件大小： | 3142K |
| 代理商： | A40MX04-PL68I |
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40MX and 42MX FPGA Families
v6.1
1-15
5V TTL Electrical Specifications
Table 9
5V TTL Electrical Specifications
Symbol
Parameter
Commercial
Commercial -F
Industrial
Military
Units
Min.
Max.
Min.
Max.
Min.
Max.
Min.
Max.
VOH
1
IOH = -10mA
2.4
V
IOH = -4mA
3.7
V
VOL
1
IOL = 10mA
0.5
V
IOL = 6mA
0.4
V
VIL
-0.3
0.8
-0.3
0.8
-0.3
0.8
-0.3
0.8
V
VIH (40MX)
2.0
VCC+0.3
2.0
VCC+0.3
2.0
VCC+0.3
2.0
VCC+0.3
V
VIH (42MX)
2.0
VCCI+0.3
2.0
VCCI+0.3
2.0
VCCI+0.3
2.0
VCCI+0.3
V
IIL
VIN = 0.5V
-10
A
IIH
VIN = 2.7V
-10
A
Input
Transition
Time, TR and TF
500
ns
CIO I/O Capacitance
10101010
pF
Standby
Current,
ICC
2
A40MX02,
A40MX04
3
251025
mA
A42MX09
5
25
mA
A42MX16
6
25
mA
A42MX24,
A42MX36
20
25
mA
Low-Power
Mode
Standby Current
42MX devices
only
0.5
ICC - 5.0
mA
IIO, I/O source sink
current
Can be derived from the IBIS model (http://www.actel.com/techdocs/models/ibis.html)
Notes:
1. Only one output tested at a time. VCC/VCCI = min.
2. All outputs unloaded. All inputs = VCC/VCCI or GND.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| A40MX04-PL68MX79 | FPGA, 547 CLBS, 6000 GATES, 80 MHz, PQCC68 |
| A40MX04-PL68M | FPGA, 547 CLBS, 6000 GATES, 80 MHz, PQCC68 |
| A40MX04-PL68X79 | FPGA, 547 CLBS, 6000 GATES, 80 MHz, PQCC68 |
| A40MX04-PL68 | FPGA, 547 CLBS, 6000 GATES, 80 MHz, PQCC68 |
| A40MX04-PL84AX79 | FPGA, 547 CLBS, 6000 GATES, 116 MHz, PQCC84 |
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參數(shù)描述 |
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