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參數資料
| 型號： | AD7720 |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | CMOS Sigma-Delta Modulator |
| 中文描述： | 的CMOSΣ-Δ調制器 |
| 文件頁數： | 4/16頁 |
| 文件大?。?/td> | 232K |
| 代理商： | AD7720 |
AD7720
TIMNGCHARACTERISTICS
(AVDD= +5 V
6
5%; DVDD= +5 V
6
5%; AGND= DGND= 0 V, REF2= +2.5 V unless otherwse noted)
–4–
REV. 0
Limit at T
MIN
, T
MAX
(B Version)
Parameter
Units
Conditions/Comments
f
MCLK
100
15
67
0.45
×
t
MCLK
0.45
×
t
MCLK
15
10
10
20
×
t
MCLK
kHz min
MHz max
ns min
ns min
ns min
ns min
ns min
ns min
ns max
Master Clock Frequency
12.5 MHz for Specified Performance
Master Clock Period
Master Clock Input High T ime
Master Clock Input Low T ime
Data Hold T ime After SCLK Rising Edge
RESET Pulsewidth
RESET Low T ime Before MCLK Rising
DVAL High Delay after RESET Low
t
1
t
2
t
3
t
4
t
5
t
6
t
7
NOT E
Guaranteed by design.
I
1.6mA
I
200 A
+1.6V
C
L
50pF
TO
OUTPUT
PIN
Figure 2. Load Circuit for Access Time and Bus Relinquish Time
SCLK (O)
DATA (O)
t
1
t
2
t
3
t
4
NOTE:
O SIGNIFIES AN OUTPUT
Figure 3. Data Timing
t
5
MCLK (I)
RESET (I)
DVAL (O)
t
6
t
7
NOTE:
I SIGNIFIES AN INPUT
O SIGNIFIES AN OUTPUT
Figure 4. RESET Timing
相關PDF資料 |
PDF描述 |
|---|---|
| AD7720BRU | CMOS Sigma-Delta Modulator |
| AD7721 | CMOS 16-Bit, 468.75 kHz, Sigma-Delta ADC |
| AD7721AN | CMOS 16-Bit, 468.75 kHz, Sigma-Delta ADC |
| AD7721AR | CMOS 16-Bit, 468.75 kHz, Sigma-Delta ADC |
| AD7721SQ | CMOS 16-Bit, 468.75 kHz, Sigma-Delta ADC |
相關代理商/技術參數 |
參數描述 |
|---|---|
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