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參數資料
| 型號： | AD9244BSTRL-65 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | ADC |
| 英文描述： | 14-Bit, 40/65 MSPS Monolithic A/D Converter |
| 中文描述： | 1-CH 14-BIT FLASH METHOD ADC, PARALLEL ACCESS, PQFP48 |
| 封裝： | MS-026-BBC, LQFP-48 |
| 文件頁數： | 23/36頁 |
| 文件大小： | 1845K |
| 代理商： | AD9244BSTRL-65 |
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REV. A
AD9244
–23–
REFIN
10MHz
REFOUT
SIGNAL SYNTHESIZER
2.5MHz, 0.8V p-p
HP8644
CLK SYNTHESIZER
65MHz, 1V p-p
HP8644
2.5MHz
BAND-PASS FILTER
AVDD
GND
DUT
AVDD
GND
DUT
DVDD
DVDD
AD9244
EVALUATION BOARD
OUTPUT
BUSS
J1
S4
INPUT
xFMR
S1/S5
INPUT
CLOCK
5V
+
–
5V
–
+
3V
–
+
3V
–
+
DSP
EQUIPMENT
CLOCK
DIVIDER
Figure 20. Evaluation Board Connections
Table VI. Reference Jumper Configuration
Reference
Voltage
Jumpers
Notes
Internal
Internal
Internal
External
2 V
1 V
1 V
≤
VREF
≤
2 V
1 V
≤
VREF
≤
2 V
23
24
25
8, 22
JP8 Not Connected.
JP8 Not Connected.
JP8 Not Connected. VREF = 1 + R1/R2.
Set VREF with R26.
Table VII. Clock Jumper Configuration
Input Connector
Jumpers
DUT Clock
Differential
Single-Ended
S5
S1
11, 13
12, 15
Data Capture Clock
Internal
Diff DUT Clock
SE DUT Clock
External
NA
NA
S6
9, 18A
9, 18B
3 or 4
Table V. Analog Input Jumper Configuration
Input
Connector
Jumpers
Notes
Differential: Transformer
Differential: Amplifier
Single-Ended
S4
S2
S3
45, 46
42, 43
5, 40, 41
R8, R28 Provide DC Bias. Optimal for 500 kHz+.
Remove T1 or T4. Used for low input frequencies.
Remove T1 or T4. JP5: connected for dc-coupled, not connected
for ac-coupling.
相關PDF資料 |
PDF描述 |
|---|---|
| AD9244-EVAL | 14-Bit, 40/65 MSPS Monolithic A/D Converter |
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| AD9245BCP-80 | 14-Bit, 80 MSPS, 3 V A/D Converter |
相關代理商/技術參數 |
參數描述 |
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