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參數(shù)資料
| 型號： | AD9846AJST |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 消費家電 |
| 英文描述： | Complete 10-Bit 30 MSPS CCD Signal Processor |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP48 |
| 封裝： | PLASTIC, LQFP-48 |
| 文件頁數(shù)： | 16/24頁 |
| 文件大小： | 231K |
| 代理商： | AD9846AJST |
REV. 0
AD9846A
–16–
Table IV. Clamp Level Register Contents (Default Value x080)
MSB
D7
LSB
D0
D10
D9
D8
D6
D5
D4
D3
D2
D1
Clamp Level (LSB)
X
X
X
0
0
0
0
0
0
0
0
0
0
0
0
1
1
0
0
0
0
0
0
0
0
1
0
1
0
0
0.25
0.5
63.5
63.75
1
1
1
1
1
1
1
1
1
1
1
1
0
1
Table V. Control Register Contents (Default Value x000)
Data Out
DATACLK
D6
CLP/PBLK
D5
SHP/SHD
D4
PxGA
D3
**
Color Steering Modes
D2 D1 D0
D10 D9
D8 D7
X
0 Enable
1 Three-State
0
*
0
*
0 Rising Edge Trigger
1 Falling Edge Trigger 1 Active High 1 Active High
0 Active Low 0 Active Low
0 Disable 0
1 Enable
0
0
1
1
0
0
1
1
0 Steering Disabled
1 Mosaic Separate
0 Interlace
1 3-Color
0 4-Color
1 VD Selected
0 Mosaic Repeat
1 User Speci
fi
ed
0
0
0
1
1
1
1
*
Must be set to zero.
**
When D3 = 0 (
PxGA
disabled) the
PxGA
gain is
fi
xed to 4 dB.
Table VI. PxGA Gain Registers for Gain0, Gain1, Gain2, Gain3 (Default Value x000)
MSB
D5
LSB
D0
D10
D9
D8
D7
D6
D4
D3
D2
D1
Gain (dB)
*
X
X
X
X
X
0
1
1
1
1
1
+10.0
+4.3
+4.0
–
2.0
0
1
0
1
0
1
0
1
0
1
0
1
1
0
0
0
0
0
*
Control Register Bit D3 must be set High (
PxGA
Enable) to use the
PxGA
Gain Registers.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AD9847 | 10-Bit 40 MSPS CCD Signal Processor with Integrated Timing Driver |
| AD9847AKST | 10-Bit 40 MSPS CCD Signal Processor with Integrated Timing Driver |
| AD9848KST | CCD Signal Processors with Integrated Timing Driver |
| AD9848 | CCD Signal Processors with Integrated Timing Driver |
| AD9849 | CCD Signal Processors with Integrated Timing Driver |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| AD9847 | 制造商:AD 制造商全稱:Analog Devices 功能描述:10-Bit 40 MSPS CCD Signal Processor with Integrated Timing Driver |
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