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參數資料
型號: ADF4007BCP
廠商: ANALOG DEVICES INC
元件分類: XO, clock
英文描述: High Frequency Divider/PLL Synthesizer
中文描述: PLL FREQUENCY SYNTHESIZER, 7500 MHz, QCC20
封裝: MO-220-VGGD-1, LFCSP-20
文件頁數: 10/16頁
文件大?。?/td> 390K
代理商: ADF4007BCP
ADF4007
MUXOUT
The output multiplexer on the ADF4007 allows the user to
access various internal points on the chip. The state of
MUXOUT is controlled by the M2 and M1 pins. Figure 12
shows the MUXOUT section in block diagram form.
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DGND
DV
DD
CONTROL
MUX
DV
DD
R COUNTER OUTPUT
N COUNTER OUTPUT
DGND
MUXOUT
0
Figure 12. MUXOUT Circuit
PFD Polarity
The PFD polarity is set by the state of M2 and M1 pins as given
in the Table 5. The ability to set the polarity allows the use of
VCOs with either positive or negative tuning characteristics. For
standard VCOs with positive characteristics (output frequency
increases with increasing tuning voltage), the polarity should be
set to positive. This is accomplished by tying M2 and M1 to a
logic low state.
CP Output
The CP output state is also controlled by the state of M2 and
M1. It can be set either to active (so that the loop can be locked)
or to three-state (open the loop). The normal state is CP output
active.
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PDF描述
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