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參數資料
| 型號： | ADSP-21062KS-160 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 數字信號處理 |
| 英文描述： | ADSP-2106x SHARC DSP Microcomputer Family |
| 中文描述： | 48-BIT, 40 MHz, OTHER DSP, PQFP240 |
| 封裝： | MS-029GA, MQFP-240 |
| 文件頁數： | 33/48頁 |
| 文件大?。?/td> | 370K |
| 代理商： | ADSP-21062KS-160 |
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ADSP-21062/ADSP-21062L
–33–
REV. C
Link Ports: 1 CLK Speed Operation
ADSP-21062
Min
ADSP-21062L
Min
Parameter
Max
Max
Units
Receive
Timing Requirements:
t
SLDCL
t
HLDCL
t
LCLKIW
t
LCLKRWL
t
LCLKRWH
Data Setup Before LCLK Low
Data Hold After LCLK Low
LCLK Period (1
×
Operation)
LCLK Width Low
LCLK Width High
3
3
t
CK
6
5
3
3
t
CK
6
5
ns
ns
ns
ns
ns
Switching Characteristics:
t
DLAHC
t
DLALC
t
ENDLK
t
TDLK
LACK High Delay After CLKIN High
LACK Low Delay After LCLK High
1
LACK Enable from CLKIN
LACK Disable from CLKIN
18 + DT/2
–3
5 + DT/2
28.5 + DT/2
13
18 + DT/2
–3
5 + DT/2
28.5 + DT/2
13
ns
ns
ns
ns
20 + DT/2
20 + DT/2
Transmit
Timing Requirements:
t
SLACH
t
HLACH
LACK Setup Before LCLK High
LACK Hold After LCLK High
18
–7
18
–7
ns
ns
Switching Characteristics:
t
DLCLK
t
DLDCH
t
HLDCH
t
LCLKTWL
t
LCLKTWH
t
DLACLK
t
ENDLK
t
TDLK
LCLK Delay After CLKIN (1
×
operation)
Data Delay After LCLK High
Data Hold After LCLK High
LCLK Width Low
LCLK Width High
LCLK Low Delay After LACK High
LDAT, LCLK Enable After CLKIN
LDAT, LCLK Disable After CLKIN
15.5
2.5
15.5
2.5
ns
ns
ns
ns
ns
–3
(t
CK
/2) – 1
(t
CK
/2) – 1.25
(t
CK
/2) + 8.75
5 + DT/2
–3
(t
CK
/2) – 1
(t
CK
/2) – 1.5
(t
CK
/2) + 1.25
(t
CK
/2) + 1
(3
×
t
CK
/2) + 17 (t
CK
/2) + 8
(t
CK
/2) + 1.5
(t
CK
/2) + 1
(3
×
t
CK
/2) + 17 ns
5 + DT/2
ns
ns
20 + DT/2
20 + DT/2
Link Port Service Request Interrupts: 1
×
and
2
×
Speed Operations
Timing Requirements:
t
SLCK
LACK/LCLK Setup Before CLKIN Low
2
t
HLCK
LACK/LCLK Hold After CLKIN Low
2
10
2
10
2
ns
ns
NOTES
1
LACK will go low with t
DLALC
relative to rising edge of LCLK after first nibble is received. LACK will not go low if the receiver’s link buffer is not about to fill.
2
Only required for interrupt recognition in the current cycle.
相關PDF資料 |
PDF描述 |
|---|---|
| ADSP-21062LKS-133 | ADSP-2106x SHARC DSP Microcomputer Family |
| ADSP-21062LKS-160 | ADSP-2106x SHARC DSP Microcomputer Family |
| ADSP-21062LCS-160 | ADSP-2106x SHARC DSP Microcomputer Family |
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相關代理商/技術參數 |
參數描述 |
|---|---|
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| ADSP-21062KSZ-160 | 功能描述:IC DSP CONTROLLER 32BIT 240MQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - DSP（數字式信號處理器） 系列:SHARC® 標準包裝:2 系列:StarCore 類型:SC140 內核 接口:DSI，以太網，RS-232 時鐘速率:400MHz 非易失內存:外部 芯片上RAM:1.436MB 電壓 - 輸入/輸出:3.30V 電壓 - 核心:1.20V 工作溫度:-40°C ~ 105°C 安裝類型:表面貼裝 封裝/外殼:431-BFBGA，FCBGA 供應商設備封裝:431-FCPBGA（20x20） 包裝:托盤 |
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| ADSP-21062LABZ-160 | 功能描述:IC DSP CONTROLLER 32BIT 225BGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - DSP（數字式信號處理器） 系列:SHARC® 標準包裝:2 系列:StarCore 類型:SC140 內核 接口:DSI，以太網，RS-232 時鐘速率:400MHz 非易失內存:外部 芯片上RAM:1.436MB 電壓 - 輸入/輸出:3.30V 電壓 - 核心:1.20V 工作溫度:-40°C ~ 105°C 安裝類型:表面貼裝 封裝/外殼:431-BFBGA，FCBGA 供應商設備封裝:431-FCPBGA（20x20） 包裝:托盤 |
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