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參數(shù)資料
| 型號： | ADSP-2173 |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | DSP Microcomputer(DSP 微計算機) |
| 中文描述： | 微機的DSP（數(shù)字信號處理器微計算機） |
| 文件頁數(shù)： | 12/52頁 |
| 文件大小： | 685K |
| 代理商： | ADSP-2173 |
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REV. A
–12–
ADSP-2171/ADSP-2172/ADSP-2173
Control Registers
ROM Enable/Data Memory Wait State
Control Register
0x3FFE
DWAIT4
DWAIT0
DWAIT1
DWAIT2
DWAIT3
ROM enable
1 = enable
0 = disable
1
1
1
1
1
1
1
0
1
1
1
1
1
1
1
1
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
SPORT0 Control Register
0x3FF6
Multichannel Enable MCE
Internal Serial Clock Generation ISCLK
Receive Frame Sync Required RFSR
Receive Frame Sync Width RFSW
Multichannel Frame Delay MFD
Only If Multichannel Mode Enabled
Transmit Frame Sync Required TFSR
Transmit Frame Sync Width TFSW
SLEN Serial Word Length
DTYPE Data Format
00 = right justify, zero-fill unused MSBs
01 = right justify, sign extend into unused MSBs
10 = compand using
μ
-law
11 = compand using A-law
INVRFS Invert Receive Frame Sync
INVTFS Invert Transmit Frame Sync
(or INVTDV Invert Transmit Data Valid
Only If Multichannel Mode Enabled)
IRFS Internal Receive Frame Sync Enable
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
ITFS Internal Transmit Frame Sync Enable
(or MCL Multichannel Length; 1 = 32 words, 0 = 24 words
Only If Multichannel Mode Enabled)
SPORT0 Multichannel Receive Word Enable Registers
1 = Channel Enabled
0 = Channel Ignored
SPORT0 Multichannel Transmit Word Enable Registers
1 = Channel Enabled
0 = Channel Ignored
0x3FF9
8
15 14 13 12 11 10
9
7
6
5
4
3
2
1
0
0x3FFA
31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16
0x3FF7
8
15 14 13 12 11 10
9
7
6
5
4
3
2
1
0
0x3FF8
31 30 29 28 27 26 25 24 23 22 21 20 19 18 17 16
相關(guān)PDF資料 |
PDF描述 |
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| ADSP-2181BS-115 | DSP Microcomputer |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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