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參數資料
| 型號： | ADSP-218XNSERIES |
| 廠商： | Analog Devices, Inc. |
| 元件分類： | 數字信號處理 |
| 英文描述： | DSP Microcomputer |
| 中文描述： | DSP微機 |
| 文件頁數： | 39/48頁 |
| 文件大?。?/td> | 1571K |
| 代理商： | ADSP-218XNSERIES |
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–39–
REV. 0
ADSP-218xN Series
LQFP Package Pinout
The LQFP package pinout is shown in the illustration below
and in
Table 27
. Pin names in bold text in the table replace
the plain-text-named functions when Mode C = 1. A + sign
separates two functions when either function can be active
for either major I/O mode. Signals enclosed in brackets [ ]
are state bits latched from the value of the pin at the
deassertion of RESET. The multiplexed pins DT1/FO,
TFS1/IRQ1, RFS1/IRQ0, and DR1/FI, are mode
selectable by setting Bit 10 (SPORT1 configure) of the
System Control Register. If Bit 10 = 1, these pins have serial
port functionality. If Bit 10 = 0, these pins are the external
interrupt and flag pins. This bit is set to 1 by default, upon
reset.
100-LEAD LQFP PIN CONFIGURATION
5
6
4
3
2
7
8
9
1
D
D
D
D
I
+
I
+
G
I
+
D
T
S
V
D
D
T
I
D
G
S
E
R
D15
D14
D13
D12
GND
D11
D10
D9
V
DDEXT
GND
D8
D7/
IWR
D6/
IRD
D5/IAL
D4/
IS
GND
V
DDINT
D3/
IACK
D2/IAD15
D1/IAD14
D0/IAD13
BG
EBG
BR
EBR
A4/IAD3
A5/IAD4
GND
A6/IAD5
A7/IAD6
A8/IAD7
A9/IAD8
A10/IAD9
A11/IAD10
A12/IAD11
A13/IAD12
GND
CLKIN
XTAL
V
DDEXT
CLKOUT
GND
V
DDINT
WR
RD
BMS
DMS
PMS
IOMS
CMS
71
70
72
73
74
69
68
67
66
65
64
75
60
59
61
62
63
58
56
55
57
54
52
51
53
1
9
9
9
9
9
9
9
9
9
9
8
8
8
8
8
8
8
8
8
8
7
7
7
7
PIN 1
IDENTIFIER
TOP VIEW
(Not to Scale)
2
2
2
2
3
3
3
3
3
3
3
3
3
3
4
4
4
4
4
4
4
4
4
4
5
11
12
10
16
17
15
14
13
18
19
20
21
22
23
24
25
ADSP-218xN
I
+
R
D
E
E
E
E
E
E
A
A
A
A
P
B
F
F
F
D
D
D
D
G
P
G
P
V
D
P
P
P
R
I
相關PDF資料 |
PDF描述 |
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