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參數資料
| 型號： | ADUC7020 |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | Precision Analog Microcontroller 12-bit Analog I/O, ARM7TDMI MCU |
| 中文描述： | 精密模擬微控制器的12位模擬I / O，ARM7TDMI的微控制器 |
| 文件頁數： | 63/80頁 |
| 文件大小： | 840K |
| 代理商： | ADUC7020 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁當前第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁
Preliminary Technical Data
ADuC702x Series
Rev. PrB | Page 63 of 80
0011 – NOT A
0100 – A AND NOT B
0101 – NOT B
0110 – EXOR
0111 – NAND
1000 – AND
1001 – EXNOR
1010 – B
1011 – NOT A OR B
1100 – A
1101 – A OR NOT B
1110 – OR
1111 – 1
0
Mux (4) control
Set
by user to bypass the flip-flop
Cleared
by user to select the flip-flop. Cleared by default
Table 53: PLACLK MMR Bit Descriptions
Bit
7
6-4
Description
Reserved
Block1 clock source selection:
000 – GPIO clock on P0.5
001 – GPIO clock on P0.0
010 – GPIO clock on P0.7
011 – HCLK
100 – OCLK
101 - Timer 1 overflow
Other –
Reserved
Reserved
Block0 clock source selection:
000 – GPIO clock on P0.5
001 – GPIO clock on P0.0
010 – GPIO clock on P0.7
011 – HCLK
100 – OCLK
101 - Timer 1 overflow
Other –
Reserved
3
2-0
Table 54: PLAIRQ MMR Bit Descriptions
Bit
15-13
12
Description
Reserved
PLA IRQ1 enable bit
Set
by user to enable IRQ1 output from PLA
Cleared
by user to disable IRQ1 output from PLA
PLA IRQ1 source
0000 – PLA element 0
0001 – PLA element 1
…
1111 – PLA element 15
Reserved
PLA IRQ0 enable bit
Set
by user to enable IRQ0 output from PLA
Cleared
by user to disable IRQ0 output from PLA
11-8
7-5
4
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