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參數資料
| 型號： | ADUC7021BCP32 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Precision Analog Microcontroller 12-bit Analog I/O, ARM7TDMI MCU |
| 中文描述： | 32-BIT, FLASH, 45.5 MHz, MICROCONTROLLER, QCC40 |
| 封裝： | 6 X 6 MM, MO-220VJJD-2, LFCSP-40 |
| 文件頁數： | 48/80頁 |
| 文件大小： | 840K |
| 代理商： | ADUC7021BCP32 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁當前第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁
ADuC702x Series
Preliminary Technical Data
8
3
2-1
0
Rev. PrB | Page 48 of 80
PWMTRIPINT
PWMTRIP
PWMPHASE
PWM trip interrupt bit
Raw signal from the PWMTRIP pin
Reserved
PWM Phase Bit
Set to ‘1’ by the MicroConverter when the timer is counting down (1
st
half)
Clear to ‘0’ by the MicroConverter when the timer is counting up (2
nd
half)
Table 27: PWMCFG MMR Bit Descriptions
Bit
9
8
0:7
Name
CHOPLO
CHOPHI
GDCLK
Description
low-side Gate Chopping enable bit
high-side Gate Chopping enable bit
PWM Gate Chopping Period (unsigned)
Table 28: PWMEN MMR bit descriptions
Bit
8
Name
0H0L_XOVR
Description
Channel 0 Output Crossover Enable Bit
Set to ‘1’ by the user to enable channel 0 output crossover
Clear to ‘0’ by the user to disable channel 0 output crossover
Channel 1 Output Crossover Enable Bit
Set to ‘1’ by the user to enable channel 1 output crossover
Clear to ‘0’ by the user to disable channel 1 output crossover
Channel 2 Output Crossover Enable Bit
Set to ‘1’ by the user to enable channel 2 output crossover
Clear to ‘0’ by the user to disable channel 2 output crossover
AL Output Enable Bit
Set to ‘1’ by the user to disable the 0L output of the PWM
Clear to ‘0’ by the user to enable the 0L output of the PWM
AH Output Enable Bit
Set to ‘1’ by the user to disable the 0H output of the PWM
Clear to ‘0’ by the user to enable the 0H output of the PWM
BL Output Enable Bit
Set to ‘1’ by the user to disable the 1L output of the PWM
Clear to ‘0’ by the user to enable the 1L output of the PWM
BH Output Enable Bit
Set to ‘1’ by the user to disable the 1H output of the PWM
Clear to ‘0’ by the user to enable the 1H output of the PWM
CL Output Enable Bit
Set to ‘1’ by the user to disable the 2L output of the PWM
Clear to ‘0’ by the user to enable the 2L output of the PWM
CH Output Enable Bit
Set to ‘1’ by the user to disable the 2H output of the PWM
Clear to ‘0’ by the user to enable the 2H output of the PWM
7
1H1L_XOVR
6
2H2L_XOVR
5
0L_EN
4
0H_EN
3
1L_EN
2
1H_EN
1
2L_EN
0
2H_EN
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PDF描述 |
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