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參數資料
| 型號： | ADV7127KRU50 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | DAC |
| 英文描述： | CMOS, 240 MHz 10-Bit High Speed Video DAC |
| 中文描述： | PARALLEL, WORD INPUT LOADING, 10-BIT DAC, PDSO24 |
| 封裝： | TSSOP-24 |
| 文件頁數： | 5/16頁 |
| 文件大小： | 307K |
| 代理商： | ADV7127KRU50 |
–5–
REV. 0
ADV7127
3.3 V TSSOP SPECIFICATIONS
1
Parameter
Min
Typ
Max
Units
Test Conditions
STATIC PERFORMANCE
Resolution (Each DAC)
Integral Nonlinearity (BSL)
Differential Nonlinearity
10
+1
+1
Bits
LSB
LSB
R
SET
= 680
R
SET
= 680
R
SET
= 680
–1
–1
0.5
0.25
DIGITAL AND CONTROL INPUTS
Input High Voltage, V
IH
Input Low Voltage, V
IL
PDOWN Input High Voltage
3
PDOWN Input Low Voltage
3
Input Current, I
IN
PSAVE Pull-Up Current
Input Capacitance, C
IN
2.0
V
V
V
V
μ
A
μ
A
pF
0.8
2.1
0.6
–1
+1
V
IN
= 0.0 V or V
DD
20
10
ANALOG OUTPUTS
Output Current
Output Compliance Range, V
OC
Output Impedance, R
OUT
Output Capacitance, C
OUT
Offset Error
Gain Error
4
2.0
0
18.5
+1.4
mA
V
k
pF
% FSR
% FSR
70
10
0
0
0
Tested with DAC Output = 0 V
FSR = 17.62 mA
VOLTAGE REFERENCE (Ext.)
Reference Range, V
REF
VOLTAGE REFERENCE (Int.)
5
Reference Range, V
REF
1.12
1.235
1.35
V
1.235
V
POWER DISSIPATION
Digital Supply Current
6
Digital Supply Current
6
Digital Supply Current
6
Analog Supply Current
Analog Supply Current
Standby Supply Current
1
2.5
4
22
5
2.6
2
4.5
6
25
mA
mA
mA
mA
mA
mA
f
CLK
= 50 MHz
f
CLK
= 140 MHz
f
CLK
= 240 MHz
R
SET
= 560
R
SET
= 4933
PSAVE = Low, Digital and Control
Inputs at V
DD
3
PDOWN Supply Current
Power Supply Rejection Ratio
20
0.1
μ
A
%/%
0.5
NOTES
1
These max/min specifications are guaranteed by characterization to be over 3.0 V to 3.6 V range.
2
Temperature range T
to T
: –40
°
C to +85
°
C at 50 MHz and 140 MHz, 0
°
C to +70
°
C at 240 MHz.
3
This power-down feature is only available on the ADV7127 in the TSSOP package.
4
Gain error = ((Measured (FSC)/Ideal (FSC) –1)
×
100), where Ideal = V
/R
SET
×
K
×
(3FFH) and K = 7.9896.
5
Internal voltage reference is available only on the ADV7127 TSSOP package.
6
Digital supply is measured with continuous clock with data input corresponding to a ramp pattern and with an input level at 0 V and V
DD
.
Specifications subject to change without notice.
(V
AA
= +3.0 V–3.6 V, V
REF
= 1.235 V, R
SET
= 560
V
, C
L
= 10 pF. All specifications T
MIN
to T
MAX2
unless otherwise noted, T
J
MAX
= 110
8
C)
相關PDF資料 |
PDF描述 |
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| ADV7127JR240 | CMOS, 240 MHz 10-Bit High Speed Video DAC |
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相關代理商/技術參數 |
參數描述 |
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| ADV7127KRZ140 | 制造商:Analog Devices 功能描述:DAC 1-CH Segment 10-bit 28-Pin SOIC W |
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