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參數資料
| 型號： | AV2636 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | 24-bit 192kHz Stereo Audio DAC |
| 中文描述： | 24位192kHz立體聲音頻DAC |
| 文件頁數： | 10/16頁 |
| 文件大?。?/td> | 821K |
| 代理商： | AV2636 |
AV2636
Product Datasheet
PROGRAMMABLE CONTROL REGISTER ASSIGNMENT
There are 4 programmable control registers in AV2636. Their function and address assignment are
described in the following tables. All the contents of the programmable control registers can be read back
through the serial control interface.
Address
(7-bit hex)
(hex)
0
CREG0[7:0]
7F
Volume control for both left and right channel
1
CREG1[7:0]
00
Device control
2
CREG2[7:0]
00
Serial audio interface mode control
3
CREG3[7:0]
00
Clock and sample rate settings
Volume Control Register (CREG0[7:0])
Address
7’h00
Register
Default Value
Function Description
CREG0[7:0]
Bit4
VOLUME[7:0]
1
Bit7
Bit6
Bit5
Bit3
Bit2
Bit1
Bit0
Default Value
0
1
1
1
1
1
1
Device Control Register (CREG1[7:0])
Address
7’h01
StdBy
Default Value
StdBy: Stand-By Control
0: disable Stand-By (default)
1: enable Stand-By for power saving
(Notes: Mute should be enabled when StdBy is enabled.)
DeEmp: De-emphasis control
0: by-pass de-emphasis filter (default)
1: enable de-emphasis filter
CREG1[7:0]
Bit4
Bit7
Bit6
DeEmp
0
Bit5
Bit3
Reserved
0
Bit2
Bit1
Bit0
Mute
0
0
0
0
0
0
Mute: Software mute control
0: do not mute the left and right channel DACs (default)
1: mute the left and right channel DACs simultaneously
Serial Audio Interface Control Register (CREG2[7:0])
Address
7’h02
Reserved
Default Value
0
SFJ: Sync Frame Adjustment
0: do not delay SF signal by 1 SC clock cycle (default)
1: delay SF signal by 1 SC clock cycle
SCJ: Serial Clock Adjustment
0: do not invert SC clock (default)
1: invert SC clock
CREG2[7:0]
Bit4
SCJ
0
Bit7
Bit6
Bit5
SFJ
0
Bit3
SAIM[1:0]
0
Bit2
Bit1
Format[1:0]
0
Bit0
0
0
0
AVS Technology, Inc.
www.avstech.com
10-16
August 18, 2004
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
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| AV2701 | 制造商:Panasonic Electric Works 功能描述: |
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