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參數資料
| 型號： | DSPIC33FJ12MC201T-I/SO |
| 廠商： | Microchip Technology |
| 文件頁數： | 37/155頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSPIC MCU/DSP 12K 20SOIC |
| 產品培訓模塊： | Asynchronous Stimulus |
| 標準包裝： | 1,600 |
| 系列： | dsPIC™ 33F |
| 核心處理器： | dsPIC |
| 芯體尺寸： | 16-位 |
| 速度： | 40 MIP |
| 連通性： | I²C，IrDA，SPI，UART/USART |
| 外圍設備： | 高級欠壓探測/復位，電機控制 PWM，QEI，POR，PWM，WDT |
| 輸入/輸出數： | 15 |
| 程序存儲器容量： | 12KB（12K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 1K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 數據轉換器： | A/D 4x10b |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 20-SOIC（0.295"，7.50mm 寬） |
| 包裝： | 帶卷 (TR) |
| 配用： | DV164033-ND - KIT START EXPLORER 16 MPLAB ICD2 DM240001-ND - BOARD DEMO PIC24/DSPIC33/PIC32 |
| 其它名稱： | DSPIC33FJ12MC201T-I/SOTR |
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dsPIC33FJ12MC201/202
DS70265E-page 22
2007-2011 Microchip Technology Inc.
3.4
CPU Control Registers
REGISTER 3-1:
SR: CPU STATUS REGISTER
R-0
R/C-0
R-0
R/C-0
R -0
R/W-0
OA
OB
SA(1)
SB(1)
OAB
SAB
DA
DC
bit 15
bit 8
R/W-0(2)
R/W-0(3)
R-0
R/W-0
IPL<2:0>(2)
RA
N
OV
Z
C
bit 7
bit 0
Legend:
C = Clear only bit
R = Readable bit
U = Unimplemented bit, read as ‘0’
S = Set only bit
W = Writable bit
-n = Value at POR
‘1’ = Bit is set
‘0’ = Bit is cleared
x = Bit is unknown
bit 15
OA:
Accumulator A Overflow Status bit
1
= Accumulator A overflowed
0
= Accumulator A has not overflowed
bit 14
OB:
Accumulator B Overflow Status bit
1
= Accumulator B overflowed
0
= Accumulator B has not overflowed
bit 13
SA:
Accumulator A Saturation ‘Sticky’ Status bit(1)
1
= Accumulator A is saturated or has been saturated at some time
0
= Accumulator A is not saturated
bit 12
SB:
Accumulator B Saturation ‘Sticky’ Status bit(1)
1
= Accumulator B is saturated or has been saturated at some time
0
= Accumulator B is not saturated
bit 11
OAB:
OA || OB Combined Accumulator Overflow Status bit
1
= Accumulators A or B have overflowed
0
= Neither Accumulators A or B have overflowed
bit 10
SAB:
SA || SB Combined Accumulator ‘Sticky’ Status bit
1
= Accumulators A or B are saturated or have been saturated at some time in the past
0
= Neither Accumulator A or B are saturated
This bit may be read or cleared (not set). Clearing this bit will clear SA and SB.
bit 9
DA: DO
Loop Active bit
1
= DO loop in progress
0
= DO loop not in progress
bit 8
DC:
MCU ALU Half Carry/Borrow bit
1
= A carry-out from the 4th low-order bit (for byte-sized data) or 8th low-order bit (for word-sized data)
of the result occurred
0
= No carry-out from the 4th low-order bit (for byte-sized data) or 8th low-order bit (for word-sized
data) of the result occurred
Note 1:
This bit can be read or cleared (not set).
2:
The IPL<2:0> bits are concatenated with the IPL<3> bit (CORCON<3>) to form the CPU Interrupt Priority
Level. The value in parentheses indicates the IPL if IPL<3> = 1. User interrupts are disabled when
IPL<3> = 1.
3:
The IPL<2:0> Status bits are read-only when NSTDIS = 1 (INTCON1<15>).
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