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參數資料
型號： EPM3064ALC44-4N
廠商： Altera
文件頁數： 1/46頁
文件大?。?/td> 0K
描述： IC MAX 3000A CPLD 64 44-PLCC
標準包裝： 390
系列： MAX® 3000A
可編程類型： 系統內可編程
最大延遲時間 tpd(1)： 4.5ns
電壓電源 - 內部： 3 V ~ 3.6 V
邏輯元件/邏輯塊數目： 4
宏單元數： 64
門數： 1250
輸入/輸出數： 34
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 44-LCC（J 形引線）
供應商設備封裝： 44-PLCC（16.58x16.58）
包裝： 管件
Altera Corporation
1
MAX 3000A
Programmable Logic
Device Family
June 2006, ver. 3.5
Data Sheet
DS-MAX3000A-3.5
Features...
■
High–performance, low–cost CMOS EEPROM–based programmable
logic devices (PLDs) built on a MAX architecture (see Table 1)
■
3.3-V in-system programmability (ISP) through the built–in
IEEE Std. 1149.1 Joint Test Action Group (JTAG) interface with
advanced pin-locking capability
–
ISP circuitry compliant with IEEE Std. 1532
■
Built–in boundary-scan test (BST) circuitry compliant with
IEEE Std. 1149.1-1990
■
Enhanced ISP features:
–
Enhanced ISP algorithm for faster programming
–
ISP_Done bit to ensure complete programming
–
Pull-up resistor on I/O pins during in–system programming
■
High–density PLDs ranging from 600 to 10,000 usable gates
■
4.5–ns pin–to–pin logic delays with counter frequencies of up to
227.3 MHz
■
MultiVoltTM I/O interface enabling the device core to run at 3.3 V,
while I/O pins are compatible with 5.0–V, 3.3–V, and 2.5–V logic
levels
■
Pin counts ranging from 44 to 256 in a variety of thin quad flat pack
(TQFP), plastic quad flat pack (PQFP), plastic J–lead chip carrier
(PLCC), and FineLine BGATM packages
■
Hot–socketing support
■
Programmable interconnect array (PIA) continuous routing structure
for fast, predictable performance
■
Industrial temperature range
Table 1. MAX 3000A Device Features
Feature
EPM3032A
EPM3064A
EPM3128A
EPM3256A
EPM3512A
Usable gates
600
1,250
2,500
5,000
10,000
Macrocells
32
64
128
256
512
Logic array blocks
2
4
8
16
32
Maximum user I/O
pins
34
66
98
161
208
tPD (ns)
4.5
5.0
7.5
tSU (ns)
2.9
2.8
3.3
5.2
5.6
tCO1 (ns)
3.0
3.1
3.4
4.8
4.7
fCNT (MHz)
227.3
222.2
192.3
126.6
116.3
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