參數資料
| 型號： | EX128-TQG64 |
| 廠商： | Microsemi SoC |
| 文件頁數： | 1/48頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA ANTIFUSE 6K 64-TQFP |
| 標準包裝： | 160 |
| 系列： | EX |
| 邏輯元件/單元數： | 256 |
| 輸入/輸出數： | 46 |
| 門數： | 6000 |
| 電源電壓： | 2.3 V ~ 2.7 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 64-LQFP |
| 供應商設備封裝： | 64-TQFP（10x10） |
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Revision 10
October 2012
I
2012 Microsemi Corporation
eX Family FPGAs
Leading Edge Performance
240 MHz System Performance
350 MHz Internal Performance
3.9 ns Clock-to-Out (Pad-to-Pad)
Specifications
3,000 to 12,000 Available System Gates
Maximum 512 Flip-Flops (Using CC Macros)
0.22 m CMOS Process Technology
Up to 132 User-Programmable I/O Pins
Features
High-Performance, Low-Power Antifuse FPGA
LP/Sleep Mode for Additional Power Savings
Advanced Small-Footprint Packages
Hot-Swap Compliant I/Os
Single-Chip Solution
Nonvolatile
Live on Power-Up
No Power-Up/Down Sequence Required for Supply
Voltages
Configurable Weak-Resistor Pull-Up or Pull-Down for
Tristated Outputs during Power-Up
Individual Output Slew Rate Control
2.5 V, 3.3 V, and 5.0 V Mixed-Voltage Operation with
5.0V Input Tolerance and 5.0V Drive Strength
Software Design Support with Microsemi Designer and
Libero Integrated Design Environment (IDE) Tools
Up to 100% Resource Utilization with 100% Pin Locking
Deterministic Timing
Unique In-System Diagnostic and Verification Capability
with Silicon Explorer II
Boundary Scan Testing in Compliance with IEEE
Standard 1149.1 (JTAG)
Fuselock Secure Programming Technology Designed
to Prevent Reverse Engineering and Design Theft
Product Profile
Device
eX64
eX128
eX256
Capacity
System Gates
Typical Gates
3,000
2,000
6,000
4,000
12,000
8,000
Register Cells
Dedicated Flip-Flops
Maximum Flip-Flops
64
128
256
512
Combinatorial Cells
128
256
512
Maximum User I/Os
84
100
132
Global Clocks
Hardwired
Routed
1
2
1
2
1
2
Speed Grades
–F, Std, –P
Temperature Grades*
C, I, A
Package (by pin count)
TQ
64, 100
100
Note: *Refer to the eX Automotive Family FPGAs datasheet for details on automotive temperature offerings.
相關PDF資料 |
PDF描述 |
|---|---|
| RMC50DRXH | CONN EDGECARD 100PS DIP .100 SLD |
| EX128-TQ64 | IC FPGA ANTIFUSE 6K 64-TQFP |
| AGLP030V5-VQ128I | IC FPGA IGLOO PLUS 30K 128-VQFN |
| HMC40DRXI | CONN EDGECARD 80POS DIP .100 SLD |
| AGLP030V5-VQG128I | IC FPGA IGLOO PLUS 30K 128-VQFN |
相關代理商/技術參數 |
參數描述 |
|---|---|
| EX128-TQG64A | 功能描述:IC FPGA ANTIFUSE 6K 64-TQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現場可編程門陣列） 系列:EX 標準包裝:152 系列:IGLOO PLUS LAB/CLB數:- 邏輯元件/單元數:792 RAM 位總計:- 輸入/輸出數:120 門數:30000 電源電壓:1.14 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 85°C 封裝/外殼:289-TFBGA，CSBGA 供應商設備封裝:289-CSP（14x14） |
| EX128-TQG64I | 功能描述:IC FPGA ANTIFUSE 6K 64-TQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現場可編程門陣列） 系列:EX 標準包裝:152 系列:IGLOO PLUS LAB/CLB數:- 邏輯元件/單元數:792 RAM 位總計:- 輸入/輸出數:120 門數:30000 電源電壓:1.14 V ~ 1.575 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 85°C 封裝/外殼:289-TFBGA，CSBGA 供應商設備封裝:289-CSP（14x14） |
| EX12BTQ64I | 制造商:ACTEL 功能描述:New |
| EX12L-120PC/3E-GL/L | 制造商:Hirose 功能描述: |
| EX12L-120PC/3E-GL/L(50) | 功能描述:集管和線殼 HIROSE ELECTRIC RoHS:否 產品種類:1.0MM Rectangular Connectors 產品類型:Headers - Pin Strip 系列:DF50 觸點類型:Pin (Male) 節距:1 mm 位置/觸點數量:16 排數:1 安裝風格:SMD/SMT 安裝角:Right 端接類型:Solder 外殼材料:Liquid Crystal Polymer (LCP) 觸點材料:Brass 觸點電鍍:Gold 制造商:Hirose Connector |
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