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參數(shù)資料
| 型號(hào)： | FM93CS56 |
| 廠(chǎng)商： | Fairchild Semiconductor Corporation |
| 元件分類(lèi)： | DRAM |
| 英文描述： | 2048-Bit Serial CMOS EEPROM With Data Protect and Sequential Read(帶連續(xù)讀操作和數(shù)據(jù)保護(hù)的2048位串行CMOS EEPROM) |
| 中文描述： | 2048位串行CMOS EEPROM，帶有數(shù)據(jù)保護(hù)和連續(xù)讀（帶連續(xù)讀操作和數(shù)據(jù)保護(hù)的2048位串行EEPROM中的CMOS） |
| 文件頁(yè)數(shù)： | 12/16頁(yè) |
| 文件大?。?/td> | 171K |
| 代理商： | FM93CS56 |
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12
www.fairchildsemi.com
FM93CS56 Rev. C.1
F
w
Timing Diagrams
(Continued)
Address
Bits(8)
CS
PE
SK
DI
DO
High - Z
t
CS
PROTECT REGISTER WRITE CYCLE (PRWRITE)
Start
Bit
93CS56:
Address bits pattern -> x-A6-A5-A4-A3-A2-A1-A0; (x -> Don't Care, can be 0 or 1); ( A6-A0 -> User defined )
Opcode
Bits(2)
1
0
1
A7
A6
A1
A0
PRE
Busy
Ready
t
WP
Address
Bits(8)
CS
PE
SK
DI
DO
High - Z
t
CS
PROTECT REGISTER DISABLE CYCLE (PRDS)
Start
Bit
93CS56:
Address bits pattern -> 0-0-0-0-0-0-0-0
Opcode
Bits(2)
1
0
0
A7
A6
A1
A0
PRE
Busy
Ready
t
WP
Address
Bits(8)
CS
PE
SK
DI
DO
93CS56:
Address bits pattern -> 1-1-1-1-1-1-1-1
High - Z
t
CS
PROTECT REGISTER CLEAR CYCLE (PRCLEAR)
Start
Bit
Opcode
Bits(2)
1
1
1
A7
A6
A1
A0
PRE
Busy
Ready
t
WP
相關(guān)PDF資料 |
PDF描述 |
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| FM93CS56EMT8 | 制造商:FAIRCHILD 制造商全稱(chēng):Fairchild Semiconductor 功能描述:(MICROWIRE⑩ Bus Interface) 2048-Bit Serial EEPROM with Data Protect and Sequential Read |
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