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參數資料
| 型號： | GS816218D-133I |
| 廠商： | GSI TECHNOLOGY |
| 元件分類： | DRAM |
| 英文描述： | 1M x 18, 512K x 36, 256K x 72 18Mb Sync Burst SRAMs |
| 中文描述： | 1M X 18 CACHE SRAM, 8.5 ns, PBGA165 |
| 封裝： | 13 X 15 MM, 1 MM PITCH, FBGA-165 |
| 文件頁數： | 8/41頁 |
| 文件大小： | 980K |
| 代理商： | GS816218D-133I |
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Tex8adx6prsi hsseiiainaeNtRcmmne o NwDsg.
GS816218(B/D)/GS816236(B/D)/GS816272(C)
Specifications cited are subject to change without notice. For latest documentation see http://www.gsitechnology.com.
Rev: 2.17 11/2004
8/41
1999, GSI Technology
GS816218/36 BGA Pin Description
Symbol
A
0
, A
1
An
DQ
A
DQ
B
DQ
C
DQ
B
A
, B
B
, B
C
, B
NC
CK
BW
GW
E
1
G
ADV
ADSP, ADSC
ZZ
FT
LBO
Type
I
I
Description
Address field LSBs and Address Counter Preset Inputs
Address Inputs
I/O
Data Input and Output pins
I
Byte Write Enable for DQ
A
, DQ
B
, DQ
C
, DQ
I/Os; active low
No Connect
Clock Input Signal; active high
Byte Write—Writes all enabled bytes; active low
Global Write Enable—Writes all bytes; active low
Chip Enable; active low
Output Enable; active low
Burst address counter advance enable; active low
Address Strobe (Processor, Cache Controller); active low
Sleep mode control; active high
Flow Through or Pipeline mode; active low
Linear Burst Order mode; active low
FLXDrive Output Impedance Control (Low = Low Impedance [High Drive], High = High Impedance [Low
Drive])
Single Cycle Deselect/Dual Cyle Deselect Mode Control
—
I
I
I
I
I
I
I
I
I
I
ZQ
I
SCD
I
TMS
I
Scan Test Mode Select
TDI
I
Scan Test Data In
TDO
O
Scan Test Data Out
TCK
PE
V
DD
V
SS
V
DDQ
I
Scan Test Clock
I
Parity Bit Enable; active low
I
Core power supply
I
I/O and Core Ground
I
Output driver power supply
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
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