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參數資料
| 型號： | GS8322ZV72GC-166 |
| 廠商： | GSI TECHNOLOGY |
| 元件分類： | DRAM |
| 英文描述： | 36Mb Pipelined and Flow Through Synchronous NBT SRAM |
| 中文描述： | 512K X 72 ZBT SRAM, 8 ns, PBGA209 |
| 封裝： | 14 X 22 MM, 1 MM PITCH, LEAD FREE, BGA-209 |
| 文件頁數： | 3/39頁 |
| 文件大小： | 975K |
| 代理商： | GS8322ZV72GC-166 |
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GS8322ZV18(B/E)/GS8322ZV36(B/E)/GS8322ZV72(C)
Specifications cited are subject to change without notice. For latest documentation see http://www.gsitechnology.com.
Rev: 1.03a 2/2006
3/39
2002, GSI Technology
GS8322ZV72 209-Bump BGA Pin Description
Symbol
Type
Description
A
0
, A
1
I
Address field LSBs and Address Counter Preset Inputs
An
I
Address Inputs
DQ
A
DQ
B
DQ
C
DQ
D
DQ
E
DQ
F
DQ
G
DQ
H
I/O
Data Input and Output pins
B
A
, B
B
I
Byte Write Enable for DQ
A
, DQ
B
I/Os; active low
B
C
,B
D
I
Byte Write Enable for DQ
C
, DQ
D
I/Os; active low
B
E
, B
F
, B
G
,B
H
I
Byte Write Enable for DQ
E
, DQ
F
, DQ
G
, DQ
H
I/Os; active low
NC
—
No Connect
CK
I
Clock Input Signal; active high
E
1
I
Chip Enable; active low
E
3
I
Chip Enable; active low
E
2
I
Chip Enable; active high
G
I
Output Enable; active low
ADV
I
Burst address counter advance enable
ZZ
I
Sleep Mode control; active high
FT
I
Flow Through or Pipeline mode; active low
LBO
I
Linear Burst Order mode; active low
MCH
I
Must Connect High
MCH
I
Must Connect High
MCL
Must Connect Low
W
I
Write Enable; active low
ZQ
I
FLXDrive Output Impedance Control
Low = Low Impedance [High Drive],
High = High Impedance [Low Drive]
CKE
I
Clock Enable; active low
相關PDF資料 |
PDF描述 |
|---|---|
| GS8322ZV72GC-166I | 36Mb Pipelined and Flow Through Synchronous NBT SRAM |
| GS8322ZV72GC-200 | 36Mb Pipelined and Flow Through Synchronous NBT SRAM |
| GS8322ZV72GC-200I | 36Mb Pipelined and Flow Through Synchronous NBT SRAM |
| GS8322ZV72GC-225 | 36Mb Pipelined and Flow Through Synchronous NBT SRAM |
| GS8322ZV72GC-225I | 36Mb Pipelined and Flow Through Synchronous NBT SRAM |
相關代理商/技術參數 |
參數描述 |
|---|---|
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