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參數資料
| 型號： | HYM72V4005GS-50- |
| 廠商： | SIEMENS AG |
| 英文描述： | 4M x 72-Bit EDO-DRAM Module |
| 中文描述： | 4米× 72位江戶記憶體模組 |
| 文件頁數： | 1/11頁 |
| 文件大小： | 70K |
| 代理商： | HYM72V4005GS-50- |
Semiconductor Group
1
4M
×
72-Bit EDO-DRAM Module
(ECC - Module)
168 pin buffered DIMM Module
HYM 72V4005GS-50/-60
HYM 72V4015GS-50/-60
168 Pin JEDEC Standard, Buffered 8 Byte Dual In-Line Memory Module
for PC main memory applications
1 bank 4M x 72 organisation
Optimized for ECC applications
Extended Data Out (EDO)
Performance:
Single + 3.3V (
±
0.3V) supply
CAS-before-RAS refresh, RAS-only-refresh
Decoupling capacitors mounted on substrate
All inputs, outputs and clock fully LVTTL & LVCMOS compatible
4 Byte interleave enabled, Dual Address inputs (A0/B0)
Buffered inputs excepts RAS and DQ
Parallel Presence detects
Utilizes eighteen 4M
×
4 -DRAMs and four BiCMOS buffers/line drivers
Two versions : HYM 72V4005GS with TSOPII-components (4 mm thickness)
HYM 72V4015GS with SOJ-components (9 mm thickness)
4096 refresh cycles / 64 ms with 12 / 10 addressing
Gold contact pad
Double sided module with 25.35 mm (1000 mil) height
-50
-60
tRAC
RAS Access Time
50 ns
60 ns
tCAC
CAS Access Time
18 ns
20 ns
tAA
Access Time from Address
30 ns
35 ns
tRC
Cycle Time
84 ns
104 ns
tHPC
EDO Mode Cycle Time
20 ns
25 ns
5.96
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PDF描述 |
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參數描述 |
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