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參數資料
| 型號： | ICS276PGILF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數： | 1/10頁 |
| 文件大小： | 0K |
| 描述： | VCXO CLK SYNTH TRPL PLL 16-TSSOP |
| 標準包裝： | 96 |
| 系列： | VersaClock™ |
| 類型： | 時鐘/頻率合成器，扇出緩沖器（分配） |
| PLL： | 帶旁路 |
| 輸入： | 晶體 |
| 輸出： | CMOS |
| 電路數： | 1 |
| 比率 - 輸入:輸出： | 1:3 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 200MHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-TSSOP（0.173"，4.40mm 寬） |
| 供應商設備封裝： | 16-TSSOP |
| 包裝： | 管件 |
| 其它名稱： | 276PGILF |
DATASHEET
TRIPLE PLL FIELD PROGRAMMABLE VCXO CLOCK SYNTHESIZER
ICS276
IDT / ICS TRIPLE PLL FIELD PROGRAMMABLE VCXO CLOCK SYNTHESIZER 1
ICS276
REV E 051310
Description
The ICS276 field programmable VCXO clock synthesizer
generates up to three high-quality, high-frequency clock
outputs including multiple reference clocks from a
low-frequency crystal input. It is designed to replace
crystals and crystal oscillators in most electronic systems.
Using IDT’s VersaClockTM software to configure PLLs and
outputs, the ICS276 contains a One-Time Programmable
(OTP) ROM for field programmability. Programming
features include VCXO and eight selectable configuration
registers.
Each of the outputs are powered by a single VDDO voltage.
VDDO may vary from 1.8 V to VDD.
Using Phase-Locked Loop (PLL) techniques, the device
runs from a standard fundamental mode, inexpensive
crystal, or clock. It can replace VCXOs, multiple crystals
and oscillators, saving board space and cost.
The ICS276 is also available in factory programmed custom
versions for high-volume applications.
Features
Packaged as 16-pin TSSOP – Pb-free, RoHS compliant
Eight addressable registers
Replaces multiple crystals and oscillators
Output frequencies up to 200 MHz at 3.3 V
Input crystal frequency of 5 to 27 MHz
Up to three reference outputs
Operating voltages of 3.3 V
VDDO output control from 1.8 V to 3.3 V
Controllable output drive levels
Advanced, low-power CMOS process
Block Diagram
Voltage
Controlled
Crystal
Oscillator
GND
2
3
VDD
PDTS
PLL2
PLL3
Divide
Logic
and
Output
Enable
Control
S2:S0
CLK1
CLK3
CLK2
3
OTP
ROM
with
PLL
Values
X2
Crystal
External capacitors
are required.
X1
PLL1
VIN
VDDO
相關PDF資料 |
PDF描述 |
|---|---|
| ICS280PGILF | IC CLK SYNTH TRPL PLL 16-TSSOP |
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| ICS307M-02ILF | IC CLK SOURCE SRL PROGR 16-SOIC |
相關代理商/技術參數 |
參數描述 |
|---|---|
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