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參數資料
| 型號： | ICS570BI |
| 英文描述： | Multiplier and Zero Delay Buffer |
| 中文描述： | 乘數和零延遲緩沖器 |
| 文件頁數： | 1/6頁 |
| 文件大小： | 96K |
| 代理商： | ICS570BI |
ICS570B
Multiplier and Zero Delay Buffer
MDS 570B A
Integrated Circuit Systems, Inc . 525 Race Street San Jose CA 95126 (408)295-9800tel www.icst.com
1
Revision 053001
PRELIMINARY INFORMATION
Packaged in 8 pin SOIC.
Pin-for-pin replacement and upgrade to
ICS570/ICS570A
Functional equivalent to AV9170 (not a pin-
for-pin replacement).
Low input to output skew of 300 ps max (>60 MHz
outputs).
Low skew (100 ps) outputs.
Ability to choose between 14 different
multipliers from 0.5X to 32X.
Input clock frequency up to 150 MHz at 3.3V.
Can recover degraded input clock duty cycle.
Output clock duty cycle of 45/55.
Power Down and Tri-State Mode.
Full CMOS clock swings with 25mA drive
capability at TTL levels.
Advanced, low power CMOS process.
Operating voltage of 3.3 V (±5%).
Industrial temperature version available
The ICS570B is a high performance Zero Delay Buffer
(ZDB) which integrates ICS’ proprietary analog/digital
Phase Locked Loop (PLL) techniques. The ICS570B,
part of ICS’ ClockBlocks family, was designed as a
performance upgrade to meet today’s higher speed and
lower voltage requirements. The zero delay feature
means that the rising edge of the input clock aligns with
the rising edges of both outputs, giving the appearance
of no delay through the device. There are two outputs on
the chip, one being a low-skew divide by two of the other.
The device incorporates an all-chip power down/tri-state
mode that stops the internal PLL and puts both outputs
into a high impedance state.
The ICS570B is ideal for synchronizing outputs in a large
variety of systems, from personal computers to data
communications to graphics/video. By allowing off-chip
feedback paths, the device can eliminate the delay
through other devices.
The ICS570B was done to improve input to output jitter
from the original ICS570M and ICS570A verisons, and is
recommended for all new 3.3 V only designs.
For 5V applications, use the ICS570A.
Block Diagram
Description
Features
divide by N
Phase
Detector,
Charge
Pump, and
Loop Filter
Voltage
Controlled
Oscillator
CLK
Output
Buffer
ICLK
CLK/2
Output
Buffer
FBIN
÷2
S1, S0
2
External feedback can come from CLK or CLK/2 (see table on page 2).
相關PDF資料 |
PDF描述 |
|---|---|
| ICS570BIT | Multiplier and Zero Delay Buffer |
| ICS570BT | Multiplier and Zero Delay Buffer |
| ICS571 | Low Phase Noise Zero Delay Buffer |
| ICS571M | Low Phase Noise Zero Delay Buffer |
| ICS571MT | Low Phase Noise Zero Delay Buffer |
相關代理商/技術參數 |
參數描述 |
|---|---|
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| ICS570BLF | 功能描述:IC MULTIPLIER/ZDB 8-SOIC RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發生器，PLL，頻率合成器 系列:ClockBlocks™ 標準包裝:2,000 系列:- 類型:PLL 頻率合成器 PLL:是 輸入:晶體 輸出:時鐘 電路數:1 比率 - 輸入:輸出:1:1 差分 - 輸入:輸出:無/無 頻率 - 最大:1GHz 除法器/乘法器:是/無 電源電壓:4.5 V ~ 5.5 V 工作溫度:-20°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:16-LSSOP（0.175"，4.40mm 寬） 供應商設備封裝:16-SSOP 包裝:帶卷 (TR) 其它名稱:NJW1504V-TE1-NDNJW1504V-TE1TR |
| ICS570BLFT | 功能描述:IC MULTIPLIER/ZD BUFFER 8-SOIC RoHS:是 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘發生器，PLL，頻率合成器 系列:ClockBlocks™ 標準包裝:2,000 系列:- 類型:PLL 頻率合成器 PLL:是 輸入:晶體 輸出:時鐘 電路數:1 比率 - 輸入:輸出:1:1 差分 - 輸入:輸出:無/無 頻率 - 最大:1GHz 除法器/乘法器:是/無 電源電壓:4.5 V ~ 5.5 V 工作溫度:-20°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:16-LSSOP（0.175"，4.40mm 寬） 供應商設備封裝:16-SSOP 包裝:帶卷 (TR) 其它名稱:NJW1504V-TE1-NDNJW1504V-TE1TR |
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