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參數資料
| 型號： | ICS650R-14LF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數： | 1/7頁 |
| 文件大小： | 0K |
| 描述： | IC NETWORKING SYSTEM CLK 20-SSOP |
| 產品變化通告： | Product Discontinuation 09/Feb/2012 |
| 標準包裝： | 55 |
| 類型： | 時鐘/頻率合成器 |
| PLL： | 是 |
| 輸入： | 時鐘，晶體 |
| 輸出： | CMOS |
| 電路數： | 1 |
| 比率 - 輸入:輸出： | 1:7 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 133.33MHz |
| 除法器/乘法器： | 無/無 |
| 電源電壓： | 3 V ~ 5.5 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-SSOP（0.154"，3.90mm 寬） |
| 供應商設備封裝： | 20-QSOP |
| 包裝： | 管件 |
| 其它名稱： | 650R-14LF |
DATASHEET
NETWORKING SYSTEM CLOCK
ICS650-14
IDT / ICS NETWORKING SYSTEM CLOCK
1
ICS650-14
REV H 051310
Description
The ICS650-14 is a low-cost, low-jitter, high-performance
clock synthesizer customized for networking systems
applications. Using analog/digital Phase-Locked Loop (PLL)
techniques, the device accepts a 25 MHz clock or
fundamental mode crystal input to produce multiple output
clocks of one fixed 25 MHz, a four (plus one) frequency
selectable bank, and two frequency selectable clocks. All
output clocks are frequency locked together. All of the
ICS650-14 outputs have zero ppm synthesis error.
Features
Packaged in 20-pin (150 mil) SSOP (QSOP)
25 MHz fundamental crystal clock or clock input
One fixed output clock of 25 MHz
One bank of four frequency selectable output clocks
Three frequency selectable clocks outputs
Zero ppm synthesis error in all clocks
Ideal for networking systems
Full CMOS output swing
Advanced, low-power sub-micron CMOS process
Operating voltage of 3.3 V or 5 V
Industrial temperature range available
Pb-free, RoHS compliant package
Block Diagram
Clock
S ynthesis and
C ontrol
Circuitry
CLK B
CLKA 1:4
25 M H z
C rystal or C lock
CLKA5
CLK C
4
O E (all outputs)
25 M H z
Crystal
B uffer/
Crystal
O scillator
X1/ICLK
X2
S E LA 0:1
S E LB 0:1
SE LC
VDD
2
GN D
2
O ptional crystal capacitors are show n and m ay be
required for tuning of initial accuracy (determ ined
once per board)
2
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PDF描述 |
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參數描述 |
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