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參數(shù)資料
| 型號： | ICS8442AYT |
| 英文描述： | 700MHZ, CRYSTAL OSCILLATOR-TO-DIFFERENTIAL LVDS FREQUENCY SYNTHESIZER |
| 中文描述： | 700MHz的，晶體振蕩器至差分LVDS的頻率合成器 |
| 文件頁數(shù)： | 1/15頁 |
| 文件大小： | 284K |
| 代理商： | ICS8442AYT |
8442AY
www.icst.com/products/hiperclocks.html
REV. C JULY 8, 2004
1
Integrated
Circuit
Systems, Inc.
ICS8442
700MH
Z
, C
RYSTAL
O
SCILLATOR
-
TO
-D
IFFERENTIAL
LVDS F
REQUENCY
S
YNTHESIZER
G
ENERAL
D
ESCRIPTION
The ICS8442 is a general purpose, dual output
Crystal-to-Differential LVDS High Frequency
Synthesizer and a member of the HiPerClockS
family of High Performance Clock Solutions from
ICS. The ICS8442 has a selectable TEST_CLK
or crystal input. The TEST_CLK input accepts LVCMOS or
LVTTL input levels and translates them to LVDS levels. The
VCO operates at a frequency range of 250MHz to 700MHz. The
VCO frequency is programmed in steps equal to the value of
the input reference or crystal frequency. The VCO and output
frequency can be programmed using the serial or parallel inter-
face to the configuration logic. The low phase noise characteris-
tics of the ICS8442 makes it an ideal clock source for Gigabit
Ethernet and Sonet applications.
B
LOCK
D
IAGRAM
P
IN
A
SSIGNMENT
F
EATURES
Dual differential LVDS outputs
Selectable crystal oscillator interface or
LVCMOS/LVTTL TEST_CLK
Output frequency range: 31.25MHz to 700MHz
Crystal input frequency range: 10MHz to 25MHz
VCO range: 250MHz to 700MHz
Parallel or serial interface for programming counter
and output dividers
RMS period jitter: 2.7ps (typical)
Cycle-to-cycle jitter: 18ps (typical)
3.3V supply voltage
0°C to 85°C ambient operating temperature
“Lead-Free” package available
32 31 30 29 28 27 26 25
9 10 11 12 13 14 15 16
1
2
3
4
5
6
7
8
24
23
22
21
20
19
18
17
XTAL1
TEST_CLK
XTAL_SEL
V
DDA
S_LOAD
S_DATA
S_CLOCK
MR
M5
M6
M7
M8
N0
N1
nc
GND
G
n
F
V
D
n
F
V
D
T
X
n
V
M
M
M
M
M
32-Lead LQFP
7mm x 7mm x 1.4mm package body
Y Package
Top View
ICS8442
HiPerClockS
ICS
OSC
VCO_SEL
XTAL_SEL
TEST_CLK
XTAL1
XTAL2
S_LOAD
S_DATA
S_CLOCK
nP_LOAD
M0:M8
N0:N1
VCO
PLL
FOUT0
nFOUT0
FOUT1
nFOUT1
TEST
CONFIGURATION
INTERFACE
LOGIC
÷
M
0
1
0
1
PHASE DETECTOR
÷
1
÷
2
÷
4
÷
8
MR
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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