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參數(shù)資料
| 型號： | ICS85210AY-31LF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 1/15頁 |
| 文件大小： | 0K |
| 描述： | IC CLK BUFFER 1:5 650MHZ 32-LQFP |
| 標準包裝： | 250 |
| 系列： | HiPerClockS™ |
| 類型： | 扇出緩沖器（分配） |
| 電路數(shù)： | 2 |
| 比率 - 輸入:輸出： | 1:5 |
| 差分 - 輸入:輸出： | 是/是 |
| 輸入： | HCSL，LVDS，LVHSTL，LVPECL，SSTL |
| 輸出： | HSTL |
| 頻率 - 最大： | 650MHz |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-LQFP |
| 供應商設備封裝： | 32-TQFP（7x7） |
| 包裝： | 托盤 |
| 其它名稱： | 85210AY-31LF |
85210AY-31
www.idt.com
REV. C JULY 10, 2012
1
ICS85210-31
LOW SKEW, DUAL, 1-TO-5
DIFFERENTIAL-TO-HSTL FANOUT BUFFER
GENERAL DESCRIPTION
The ICS85210-31 is a low skew, high performance
dual 1-to-5 Differential-to-HSTL Fanout Buffer.The
CLKx, nCLKx pairs can accept most standard differential
input levels. The ICS85210-31 is character ized to
operate from a 3.3V power supply. Guaranteed
output and part-to-part skew characteristics make
the ICS85210-31 ideal for those clock distribution
applications demanding well defined performance
and repeatability.
FEATURES
Dual 1-to-5 HSTL compatible bank outputs
2 selectable differential clock input pairs
CLKx, nCLKx pairs can accept the following differential
input levels: LVPECL, LVDS, HSTL, SSTL, HCSL
Maximum output frequency: 650MHz
Translates any single ended input signal to
LVHSTL levels with resistor bias on nCLKx inputs
Output skew: 50ps (maximum)
Part-to-part skew: 350ps (maximum)
Propagation delay: 2ns (maximum)
3.3V core, 1.8V output operating supply
0°C to 70°C ambient operating temperature
Available in both standard (RoHS 5) and lead-free
(RoHS 6) packages
Industrial temperature information available upon request
BLOCK DIAGRAM
PIN ASSIGNMENT
32 31 30 29 28 27 26 25
9
10 11 12 13 14 15 16
1
2
3
4
5
6
7
8
24
23
22
21
20
19
18
17
QA3
nQA3
QA4
nQA4
QB0
nQB0
QB1
nQB1
VDD
CLK0_EN
CLK0
nCLK0
CLK1_EN
CLK1
nCLK1
GND
V
DDO
QB2
nQB2
QB3
nQB3
QB4
nQB4
V
DDO
V
DDO
nQA2
QA2
nQA1
QA1
nQA0
QA0
V
DDO
32-Lead LQFP
7mm x 7mm x 1.4mm package body
Y Package
Top View
ICS85210-31
QA0
nQA0
QA1
nQA1
QA2
nQA2
QA3
nQA3
QA4
nQA4
CLK0
nCLK0
CLK0_EN
D
Q
LE
QB0
nQB0
QB1
nQB1
QB2
nQB2
QB3
nQB3
QB4
nQB4
CLK1
nCLK1
CLK1_EN
D
Q
LE
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PDF描述 |
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