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參數資料
| 型號： | ICS8523AGI-03LNT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數： | 1/16頁 |
| 文件大小： | 0K |
| 描述： | IC CLOCK BUFFER MUX 2:4 20-TSSOP |
| 標準包裝： | 2,500 |
| 系列： | HiPerClockS™ |
| 類型： | 扇出緩沖器（分配），多路復用器 |
| 電路數： | 1 |
| 比率 - 輸入:輸出： | 2:4 |
| 差分 - 輸入:輸出： | 是/是 |
| 輸入： | HCSL，LVDS，LVHSTL，LVPECL，SSTL |
| 輸出： | LVHSTL |
| 頻率 - 最大： | 650MHz |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-TSSOP（0.173"，4.40mm 寬） |
| 供應商設備封裝： | 20-TSSOP |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 8523AGI-03LNT |
8523AGI-03
www.idt.com
REV. A AUGUST 12, 2010
1
ICS8523I-03
LOW SKEW, 1-TO-4
DIFFERENTIAL-TO-LVHSTL FANOUT BUFFER
BLOCK DIAGRAM
PIN ASSIGNMENT
ICS8523I-03
20-Lead TSSOP
6.5mm x 4.4mm x 0.92mm body package
G Package
Top View
GND
CLK_EN
CLK_SEL
CLK0
nCLK0
CLK1
nCLK1
nc
VDD
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
Q0
nQ0
VDDO
Q1
nQ1
Q2
nQ2
VDDO
Q3
nQ3
GENERAL DESCRIPTION
The ICS8523I-03 is a low skew, high performance 1-to-4
Differential-to-LVHSTL fanout buffer. The ICS8523I-03 has
two selectable clock inputs.The input pairs can accept most
standard differential input levels. The clock enable is
internally synchronized toeliminate runt pulses on the
outputs during asynchronousassertion/deassertion of the
clock enable pin.
Guaranteed output and part-to-part skew characteristics
make the ICS8523I-03 ideal for those applications
demanding well defined performance and repeatability.
FEATURES
4 differential LVHSTL compatible outputs
Selectable differential CLK0, nCLK0 and CLK1, nCLK1
clock inputs
Clock input pairs can accept the following differential
input levels: LVDS, LVPECL, LVHSTL, SSTL, HCSL
Maximum output frequency: 650MHz
Translates any single-ended input signal to LVHSTL
levels with resistor bias on nCLK input
Output skew: 50ps (maximum)
Part-to-part skew: 400ps (maximum)
Propagation delay: 1.2ns (typical)
V
OH = 1V (maximum)
3.3V core, 1.8V output operating supply
Lead-Free package available
-40°C to 85°C ambient operating temperature
CLK0
nCLK0
CLK1
nCLK1
Q0
nQ0
Q1
nQ1
Q2
nQ2
Q3
nQ3
0
1
CLK_EN
CLK_SEL
D
Q
LE
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