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參數(shù)資料
| 型號： | ICS8531AY-01T |
| 英文描述： | LOW SKEW, 1-TO-9 DIFFERENTIAL-TO-3.3V LVPECL FANOUT BUFFER |
| 中文描述： | 低偏移，1到9差分至3.3伏的LVPECL扇出緩沖器 |
| 文件頁數(shù)： | 1/13頁 |
| 文件大?。?/td> | 145K |
| 代理商： | ICS8531AY-01T |
8531AY-01
www.icst.com/products/hiperclocks.html
REV. B AUGUST 9, 2001
1
ICS8531-01
L
OW
S
KEW
, 1-
TO
-9
D
IFFERENTIAL
-
TO
-3.3V LVPECL F
ANOUT
B
UFFER
G
ENERAL
D
ESCRIPTION
The ICS8531-01 is a low skew, high performance
1-to-9 Differential-to-3.3V LVPECL Fanout Buffer
and a member of the HiPerClockS
family of High Performance Clock Solutions from
ICS. The ICS8531-01 has two selectable clock
inputs. The CLK, nCLK pair can accept most standard
differential input levels. The PCLK, nPCLK pair can accept
LVPECL, CML, or SSTL input levels. The clock enable is
internally synchronized to eliminate runt pulses on the out-
puts during asynchronous assertion/deassertion of the clock
enable pin.
Guaranteed output skew and part-to-part skew characteris-
tics make the ICS8531-01 ideal for high performance work-
station and server applications.
HiPerClockS
,&6
F
EATURES
9 differential 3.3V LVPECL outputs
Selectable CLK, nCLK or LVPECL clock inputs
CLK, nCLK pair can accept the following differential input
levels: LVDS, LVPECL, LVHSTL, SSTL, HCSL
PCLK, nPCLK supports the following input types:
LVPECL, CML, SSTL
Maximum output frequency up to 500MHz
Translates any single ended input signal (LVCMOS, LVTTL,
GTL) to 3.3V LVPECL levels with resistor bias on nCLK input
Output skew: 50ps (maximum)
Part-to-part skew: 250ps (maximum)
Propagation delay: 2ns (maximum)
3.3V operating supply
0
°
C to 70
°
C ambient operating temperature
Industrial temperature information available upon request
B
LOCK
D
IAGRAM
P
IN
A
SSIGNMENT
32 31 30 29 28 27 26 25
9 10 11 12 13 14 15 16
1
2
3
4
5
6
7
8
24
23
22
21
20
19
18
17
V
CCO
Q3
nQ3
Q4
nQ4
Q5
nQ5
V
CCO
ICS8531-01
V
Q
n
Q
n
Q
n
V
V
C
n
Q
n
Q
n
Q
V
C
V
CC
CLK
nCLK
CLK_SEL
PCLK
nPCLK
V
EE
CLK_EN
32-Lead LQFP
7mm x 7mm x 1.4mm package body
Y package
Top View
CLK
nCLK
PCLK
nPCLK
Q0
nQ0
Q1
nQ1
Q2
nQ2
Q3
nQ3
Q4
nQ4
Q5
nQ5
Q6
nQ6
Q7
nQ7
Q8
nQ8
D
Q
LE
CLK_EN
CLK_SEL
0
1
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