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參數(shù)資料
| 型號(hào)： | ICS8536AG-02LFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁(yè)數(shù)： | 1/17頁(yè) |
| 文件大小： | 0K |
| 描述： | IC CLOCK BUFFER MUX 3:6 24-TSSOP |
| 標(biāo)準(zhǔn)包裝： | 2,500 |
| 系列： | HiPerClockS™ |
| 類型： | 扇出緩沖器（分配），多路復(fù)用器 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 3:6 |
| 差分 - 輸入:輸出： | 無(wú)/是 |
| 輸入： | LVCMOS，LVTTL，晶體 |
| 輸出： | LVPECL |
| 頻率 - 最大： | 266MHz |
| 電源電壓： | 2.375 V ~ 3.465 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 24-TSSOP（0.173"，4.40mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 24-TSSOP |
| 包裝： | 帶卷 (TR) |
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DATA SHEET
ICS8536AG-02 REVISION A JULY 21, 2010
1
2010 Integrated Device Technology, Inc.
Low Skew, 1-to-6, Dual Crystal/LVCMOS-to-
3.3V, 2.5V LVPECL Fanout Buffer
ICS8536-02
General Description
The ICS8536-02 is a low skew, high performance 1-to-6, Dual
Crystal or LVCMOS Input-to-3.3V, 2.5V LVPECL Fanout Buffer. The
ICS8536-02 has selectable crystal or single ended clock input. The
single ended clock input accepts LVCMOS or LVTTL input levels and
translates them to LVPECL levels. The output enable is internally
synchronized to eliminate runt pulses on the outputs during
asynchronous assertion/deassertion of the clock enable pin.
Guaranteed output and part-to-part skew characteristics make the
ICS8536-02 ideal for those applications demanding well defined
performance and repeatability.
Features
Six 3.3V, 2.5V differential LVPECL output pairs
Selectable crystal oscillator interface
or LVCMOS/LVTTL single-ended input
Maximum output frequency: 266MHz
Crystal frequency range: 14MHz – 40MHz
Output skew: 55ps (maximum)
Part-to-part skew: 500ps (maximum)
Propagation delay: 1.85ns (maximum), 3.3V
Additive phase jitter, RMS: 0.149ps (typical)
Full 3.3V or 2.5V supply modes
0°C to 70°C ambient operating temperature
Industrial temperature information available upon request
Available in both standard (RoHS 5) and lead-free (RoHS 6)
packages
Pin Assignment
ICS8536-02
24-Lead TSSOP
4.4mm x 7.8mm x 0.925mm package body
G Package
Top View
Block Diagram
00
01
1X
OSC
D
LE
Q
Q0
nQ0
Q5
nQ5
6 LVPECL Outputs
Pullup
Pulldown
CLK_EN
CLK_SEL0
CLK_SEL1
XTAL_IN0
XTAL_OUT0
XTAL_IN1
XTAL_OUT1
CLK0
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
nQ2
Q2
VCC
nQ1
Q1
VEE
nQ0
Q0
CLK_SEL0
XTAL_IN0
XTAL_OUT0
CLK_EN
Q3
nQ3
Q4
VCC
nQ4
Q5
nQ5
CLK_SEL1
XTAL_OUT1
XTAL_IN1
CLK0
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