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參數(shù)資料
| 型號： | ICS8602BYT |
| 英文描述： | ZERO DELAY, DIFFERENTIAL-TO-LVCMOS/LVTTL |
| 中文描述： | 零延遲，DIFFERENTIAL-TO-LVCMOS/LVTTL |
| 文件頁數(shù)： | 1/10頁 |
| 文件大小： | 148K |
| 代理商： | ICS8602BYT |
8602BY
www.icst.com/products/hiperclocks.html
REV. F APRIL 16, 2003
1
ICS8602
Z
ERO
D
ELAY
, D
IFFERENTIAL
-
TO
-LVCMOS/LVTTL
C
LOCK
G
ENERATOR
PRELIMINARY
G
ENERAL
D
ESCRIPTION
The ICS8602 is a high performance, low skew,
1-to-9 Differential-to-LVCMOS/LVTTL Zero De-
lay Buffer and a member of the HiPerClockS
family of High Performance Clocks Solutions
from ICS. The CLK, nCLK pair can accept most
standard differential input levels. The VCO operates at a fre-
quency range of 250MHz to 500MHz. The external feedback
allows the device to achieve “zero delay” between the input
clock and the output clocks. The device is designed only for
1:1 input/output frequency ratios. The output divider allows a
wide input/output frequency range with the 250MHz to
500MHz VCO. The PLL_SEL pin can be used to bypass the
PLL for system test and debug purposes. In bypass mode,
the reference clock is routed around the PLL and into the in-
ternal output dividers.The low impedance LVCMOS/LVTTL out-
puts are designed to drive 50
series or parallel terminated
transmission lines. The effective fanout can be doubled by
utilizing the ability of the outputs to drive two series termi-
nated lines. The differential reference clock input will accept
any differential signal levels.
B
LOCK
D
IAGRAM
P
IN
A
SSIGNMENT
F
EATURES
Fully integrated PLL
9 LVCMOS/LVTTL outputs, 7
typical output impedance
CLK, nCLK pair can accept the following differential
input levels: LVPECL, LVDS, LVHSTL, SSTL, HCSL
Output frequency range: 15.625MHz to 250MHz
Input frequency range: 15.625MHz to 250MHz
VCO range: 250MHz to 500MHz
External feedback for “zero delay” clock regeneration
with configurable frequencies
Cycle-to-cycle jitter: 36ps (typical)
Output skew: 125ps (maximum)
Static Phase Offset: TBD±100ps (typical)
3.3V supply voltage
0°C to 70°C ambient operating temperature
32 31 30 29 28 27 26 25
9 10 11 12 13 14 15 16
1
2
3
4
5
6
7
8
24
23
22
21
20
19
18
17
V
DDO
Q5
GND
Q4
V
DDO
Q3
GND
MR/nOE
V
DDA
V
DD
CLK
nCLK
GND
DIV_SEL0
DIV_SEL1
GND
G
Q
V
D
Q
G
Q
V
D
F
G
Q
V
D
Q
G
Q
V
D
P
32-Lead LQFP
7mm x 7mm x 1.4mm package body
Y Package
Top View
ICS8602
The Preliminary Information presented herein represents a product in prototyping or pre-production. The noted characteristics are based on initial
product characterization. Integrated Circuit Systems, Incorporated (ICS) reserves the right to change any circuitry or specifications without notice.
HiPerClockS
Q0
Q1
Q2
Q3
Q4
Q5
Q6
Q7
Q8
SEL0
SEL1
CLK
nCLK
FB_IN
PLL_SEL
MR/nOE
0
1
PLL
÷
2
÷
4
÷
8
÷
16
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ICS8624 | LOW SKEW, 1-TO-5 DIFFERENTIAL-TO-HSTL ZERO DELAY BUFFER |
| ICS8624BYLF | LOW SKEW, 1-TO-5 DIFFERENTIAL-TO-HSTL ZERO DELAY BUFFER |
| ICS8624BYLFT | LOW SKEW, 1-TO-5 DIFFERENTIAL-TO-HSTL ZERO DELAY BUFFER |
| ICS8624BYT | LOW SKEW, 1-TO-5 DIFFERENTIAL-TO-HSTL ZERO DELAY BUFFER |
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參數(shù)描述 |
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| ICS8633AF-01LF | 功能描述:IC BUFFER ZD 2-3 LVPECL 28-SSOP RoHS:是 類別:集成電路 (IC) >> 時鐘/計(jì)時 - 時鐘發(fā)生器，PLL，頻率合成器 系列:HiPerClockS™ 標(biāo)準(zhǔn)包裝:1,000 系列:Precision Edge® 類型:時鐘/頻率合成器 PLL:無 輸入:CML，PECL 輸出:CML 電路數(shù):1 比率 - 輸入:輸出:2:1 差分 - 輸入:輸出:是/是 頻率 - 最大:10.7GHz 除法器/乘法器:無/無 電源電壓:2.375 V ~ 3.6 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:16-VFQFN 裸露焊盤，16-MLF? 供應(yīng)商設(shè)備封裝:16-MLF?（3x3） 包裝:帶卷 (TR) 其它名稱:SY58052UMGTRSY58052UMGTR-ND |
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