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參數資料
型號: ICS94220YFLF-T
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: 時鐘產生/分配
英文描述: 133.3 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48
封裝: 0.300 INCH, MO-118, SSOP-48
文件頁數: 1/18頁
文件大小: 145K
代理商: ICS94220YFLF-T
Integrated
Circuit
Systems, Inc.
ICS94220
0443A—07/03/02
Block Diagram
Functionality
Pin Configuration
48-Pin 300mil SSOP
Recommended Application:
VIA KX/KT133 style chipset
Output Features:
1 - Differential pair open drain CPU clocks
1 - CPU clock @ 3.3V
13 - SDRAM @ 3.3V
6 - PCI @3.3V,
1 - 48MHz, @3.3V fixed.
1 - 24/48MHz @ 3.3V
2 - REF @3.3V, 14.318MHz.
Features:
Programmable ouput frequency.
Programmable ouput rise/fall time.
Programmable PCI_F and PCICLK skew.
Real time system reset output
Spread spectrum for EMI control typically
by 7dB to 8dB,
with programmable spread percentage.
Watchdog timer technology to reset system
if over-clocking causes malfunction.
Uses external 14.318MHz crystal.
FS pins for frequency select
Programmable System Clock Chip for AMD - K7 Processor
*
Internal Pull-up Resistor of 120K to VDD
VDD1
REF0/CPU_STOP#*
GND
X1
X2
VDD2
*MODE/PCICLK_F
*FS3/PCICLK0
GND
*SEL24_48#/PCICLK1
PCICLK2
PCICLK3
PCICLK4
VDD2
BUFFER IN
GND
SDRAM11
SDRAM10
VDD3
SDRAM9
SDRAM8
GND
SDATA
SCLK
REF1/FS2*
GND
CPUCLK
GND
CPUCLKC0
CPUCLKT0
VDDCPU
RESET#*
SDRAM_OUT
GND
SDRAM0
SDRAM1
VDD3
SDRAM2
SDRAM3
GND
SDRAM4
SDRAM5
VDD3
SDRAM6
SDRAM7
VDD4
48MHz/FS0*
24/48MHz/FS1*
ICS94220
1
2
3
4
5
6
7
8
9
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45
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42
41
40
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37
36
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33
32
31
30
29
28
27
26
25
3
S
F2
S
F1
S
F0
S
F
U
P
C
)
z
H
M
(
K
L
C
I
C
P
)
z
H
M
(
0000
0
.
0
90
0
.
0
3
000
1
0
.
5
97
6
.
1
3
00
1
0
.
1
0
17
6
.
3
00
11
0
.
2
0
10
0
.
4
3
01
0
9
.
0
17
5
.
3
01
0
.
3
0
13
3
.
4
3
01
1
0
.
5
0
10
0
.
5
3
0
111
0
.
0
13
3
.
3
1
000
0
.
7
0
17
6
.
5
3
10
0
1
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.
9
0
13
3
.
6
3
10
0
.
0
1
17
6
.
6
3
10
1
0
.
1
10
0
.
7
3
11
00
0
.
3
1
17
6
.
7
3
11
0
1
0
.
5
1
13
3
.
8
3
111
0
.
7
1
10
0
.
9
3
1111
0
3
.
3
13
3
.
3
SEL24_48#
SDATA
SCLK
FS (3:0)
CPU_STOP#
BUFFER IN
PLL2
PLL1
Spread
Spectrum
48MHz
24_48MHz
SDRAM (11:0)
PCICLK (4:0)
RESET#
PCICLK_F
SDRAM_OUT
CPUCLKT0
CPUCLK
CPUCLKC0
X1
X2
XTAL
OSC
CPU
DIVDER
PCI
DIVDER
Stop
Control
Logic
Config.
Reg.
/ 2
REF (1:0)
SDRAM
DRIVER
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PDF描述
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