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參數資料
| 型號： | ICS94222 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | Programmable System Frequency Generator for PII/III⑩ |
| 中文描述： | 可編程系統頻率發生器有價證券/三⑩ |
| 文件頁數： | 1/19頁 |
| 文件大小： | 419K |
| 代理商： | ICS94222 |
Integrated
Circuit
Systems, Inc.
ICS94222
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without written consents from ICS.
94222 Rev - 5/10/01
Advance Information
ADVANCE INFORMATION documents contain information on products in the
formative or design phase development. Characteristic data and other
specifications are design goals. ICS reserves the right to change or discontinue
these products without notice.
Pin Configuration
Recommended Application:
BX, Appollo Pro 133 type of chip set.
Output Features:
3 - CPUs @2.5V, up to 166MHz.
17 - SDRAM @ 3.3V, up to 166MHz.
7 - PCI @3.3V
2 - IOAPIC @ 2.5V
1 - 48MHz, @3.3V fixed.
1 - 24MHz @ 3.3V
2 - REF @3.3V, 14.318MHz.
Features:
Programmable ouput frequency.
Programmable ouput rise/fall time.
Programmable PCI_F and PCICLK skew.
Spread spectrum for EMI control typically by 7dB to 8dB,
with programmable spread percentage.
Watchdog timer technology to reset system
if over-clocking causes malfunction.
Uses external 14.318MHz crystal.
FS pins for frequency select
Key Specifications:
CPU – CPU: <175ps
SDRAM - SDRAM: <500ps
PCI – PCI: <500ps
CPU-SDRAM: <500ps
CPU(early)-PCI: Min=1.0ns, Typ=2.0ns, Max=4.0ns
Programmable System Frequency Generator for P
II
/
III
Block Diagram
Functionality
56-Pin SSOP
* Internal Pull-up Resistor of 240K to 3.3V on indicated inputs
AVDD
*FS2/REF1
*PCI_STOP#/REF0
GND
X1
X2
VDD
*MODE/PCICLK_F
*FS3/PCICLK0
GND
VDD
BUFFERIN
SDRAM11
SDRAM10
VDD
SDRAM9
SDRAM8
GND
SDRAM15
SDRAM14
GND
SDATA
SCLK
PCICLK1
PCICLK2
PCICLK3
PCICLK4
PCICLK5
VDDL
IOAPIC0
IOAPIC_F
GND
CPUCLK_F
CPUCLK0
VDDL
CPUCLK1
GND
CLK_STOP*
SDRAM_F
VDDSDR
SDRAM0
SDRAM1
GND
SDRAM2
SDRAM3
SDRAM4
SDRAM5
VDD
SDRAM6
SDRAM7
GND
SDRAM12
SDRAM13
AVDD48
24MHz/FS0*
48MHz/FSI*
1
I
1
2
3
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6
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41
40
39
38
37
36
35
34
33
32
31
30
29
3
S
F
2
S
F
1
S
F
0
S
F
U
)
H
0
0
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P
C
M
(
K
L
)
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5
C
H
I
C
M
(
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P
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1
1
0
9
9
0
0
0
0
CLK_STOP#
PCI_STOP#
PLL2
PLL1
Spread
Spectrum
48MHz
IOAPIC0
CPUCLK (1:0)
CPUCLK_F
IOAPIC_F
SDRAM (15:0)
SDRAM_F
PCICLK (5:0)
PCICLK_F
X1
X2
XTAL
OSC
PCI
CLOCK
DIVDER
STOP
STOP
÷2
STOP
STOP
POR
SDATA
SCLK
FS (3:0)
MODE
Control
Logic
Config.
Reg.
REF [1:0]
24MHz
LATCH
1
2
16
6
BUFFERIN
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