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參數(shù)資料
| 型號(hào)： | ICS95V157AGT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁(yè)數(shù)： | 1/9頁(yè) |
| 文件大小： | 0K |
| 描述： | IC CLK BUFF 1:10 233MHZ 48-TSSOP |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 類型： | 扇出緩沖器（分配） |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:10 |
| 差分 - 輸入:輸出： | 無/是 |
| 輸入： | 時(shí)鐘 |
| 輸出： | SSTL-2 |
| 頻率 - 最大： | 233MHz |
| 電源電壓： | 2.3 V ~ 2.7 V |
| 工作溫度： | 0°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-TFSOP（0.240"，6.10mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 48-TSSOP |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 95V157AGT |
Integrated
Circuit
Systems, Inc.
ICS95V157
0501C—11/24/08
Block Diagram
2.5V Single-Ended to SSTL_2 Clock Driver (45MHz - 233MHz)
Pin Configuration
48-Pin TSSOP
Recommended Application:
Single-ended clock input with zero delay board fan out
Product Description/Features:
Low skew, low jitter PLL clock driver
1 to 10 differential clock distribution (SSTL_2)
Feedback pin for input to output synchronization
PD# for power management
Spread Spectrum tolerant inputs
Switching Characteristics:
CYCLE - CYCLE jitter: <60ps
OUTPUT - OUTPUT skew: <60ps
Period jitter: ±30ps
DUTY CYCLE: 49.5% - 50.5%
Functionality
6.10 mm. Body, 0.50 mm. pitch = TSSOP
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