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參數資料
型號: ICS9FG108YFLF-T
英文描述: Programmable FTG for Differential P4 CPU, PCI-Express & SATA Clocks
中文描述: 可編程FTG微分小的CPU和PCI - Express
文件頁數: 1/13頁
文件大小: 145K
代理商: ICS9FG108YFLF-T
Integrated
Circuit
Systems, Inc.
ICS9FG108
Advance Information
0823—04/02/04
Pin Configuration
Recommended Application:
Frequency Timing Generator for Differential CPU, PCI-Express
& SATA clocks
Features:
Generates common frequencies from 14.318 MHz or 25
MHz
Crystal or reference input
8 - 0.7V current-mode differential output pairs
Supports Serial-ATA at 100 MHz
Two spread spectrum modes: 0 to -0.5 downspread and
+/-0.25% centerspread
Unused inputs may be disabled in either driven or Hi-Z
state for power management.
Key Specifications:
Output cycle-to-cycle jitter < 85 ps
Output to output skew < 85 ps
+/-300 ppm frequency accuracy on output clocks
Programmable FTG for Differential P4
TM
CPU, PCI-Express & SATA Clocks
48-pin SSOP & TSSOP
Frequency Select Table
SEL14M_25M#
(FS3)
0
0
0
0
0
0
0
0
1
1
1
1
1
1
1
1
FS2 FS1 FS0 OUTPUT(MHz)
0
0
0
0
1
1
1
1
0
0
0
0
1
1
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
0
1
100.00
125.00
133.33
166.67
200.00
266.66
333.33
400.00
100.00
125.00
133.33
166.67
200.00
266.66
333.33
400.00
XIN/CLKIN
1
2
3
4
5
6
7
8
9
48 VDDA
47 GNDA
46 IREF
45 FS0
44 FS1
43 OE_0**
42 DIF_0
41 DIF_0#
40 VDD
39 DIF_1
38 DIF_1#
37 OE_1*
36 VDD
35 GND
34 OE_2*
33 DIF_2
32 DIF_2#
31 VDD
30 DIF_3
29 DIF_3#
28 OE_3**
27 SEL14M_25M#
26 SPREAD
25 DIF_STOP#
X2
VDD
GND
REFOUT
FS2
OE_7**
DIF_7
DIF_7#
VDD 10
DIF_6 11
DIF_6# 12
OE_6* 13
VDD 14
GND 15
OE_5* 16
DIF_5 17
DIF_5# 18
VDD 19
DIF_4 20
DIF_4# 21
OE_4** 22
SDATA 23
SCLK 24
Note:
Pin names followed by '**' have 120 Kohm pull DOWN resistors
Pin names followed by an '*' have 120 Kohm pull UP resistors
I
ADVANCE INFORMATION
documents contain information on products in the formative or design phase development. Characteristic data and other specifications are design goals.
Third party brands and names are the property of their respective owners
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PDF描述
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