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參數資料
| 型號： | IDT5T915PAI |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | 時鐘及定時 |
| 英文描述： | 2.5V DIFFERENTIAL 1:5 CLOCK BUFFER TERABUFFER |
| 中文描述： | 5T SERIES, LOW SKEW CLOCK DRIVER, 5 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO48 |
| 封裝： | TSSOP-48 |
| 文件頁數： | 1/19頁 |
| 文件大小： | 127K |
| 代理商： | IDT5T915PAI |
INDUSTRIAL TEMPERATURE RANGE
IDT5T915
2.5V DIFFERENTIAL 1:5 CLOCK BUFFER TERABUFFER
1
FEBRUARY 2003
IDT5T915
INDUS T RIAL T E MPE RAT URE RANGE
2.5V DIFFERENTIAL
1:5 CLOCK BUFFER
TERABUFFER
DESCRIPTION:
The IDT5T915 2.5V differential (DDR) clock buffer is a user-selectable
single-ended or differential input to five differential outputs built on advanced
metal CMOS technology. The differential clock buffer fanout froma single or
differential input to five differential or single-ended outputs reduces loading on
the preceding driver and provides an efficient clock distribution network. The
IDT5T915 can act as a translator froma differential HSTL, eHSTL, 1.8V/2.5V
LVTTL, LVEPECL, or single-ended 1.8V/2.5V LVTTL input to HSTL, eHSTL,
1.8V/2.5V LVTTL outputs. Selectable interface is controlled by 3-level input
signals that may be hard-wired to appropriate high-md-low levels.
The IDT5T915 true or complementary outputs can be asynchronously
enabled/disabled. Multiple power and grounds reduce noise.
The IDT logo is a registered trademark of Integrated Device Technology, Inc.
2003 Integrated Device Technology, Inc.
DSC-5893/21
FEATURES:
Guaranteed Low Skew < 25ps (max)
Very low duty cycle distortion < 300ps (max)
High speed propagation delay < 2ns (max)
Up to 250MHz operation
Very low CMOS power levels
Hot insertable and over-voltage tolerant inputs
3-level inputs for selectable interface
Selectable HSTL, eHSTL, 1.8V / 2.5V LVTTL, or LVEPECL input
interface
Selectable differential or single-ended inputs and five differen-
tial outputs
2.5V V
DD
Available in TSSOP package
FUNCTIONAL BLOCK DIAGRAM
APPLICATIONS:
Clock and signal distribution
TxS
GL
G(+)
RxS
A
A/V
REF
G(-)
OUTPUT
CONTROL
OUTPUT
CONTROL
OUTPUT
CONTROL
OUTPUT
CONTROL
OUTPUT
CONTROL
OUTPUT
CONTROL
OUTPUT
CONTROL
OUTPUT
CONTROL
OUTPUT
CONTROL
OUTPUT
CONTROL
Q1
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Q2
Q2
Q3
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Q4
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Q5
Q5
相關PDF資料 |
PDF描述 |
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