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參數資料
| 型號： | IDT5V9910A |
| 廠商： | Integrated Device Technology, Inc. |
| 英文描述： | 3.3V LOW SKEW PLL CLOCK DRIVER TURBOCLOCK JR |
| 中文描述： | 3.3V的低偏移的PLL時鐘驅動器TURBOCLOCK JR |
| 文件頁數： | 1/6頁 |
| 文件大小： | 88K |
| 代理商： | IDT5V9910A |
1
COMMERCIAL AND INDUSTRIAL TEMPERATURE RANGES
IDT5V9910A
3.3V LOW SKEW PLL CLOCK DRIVER TURBOCLOCK JR.
SEPTEMBER 2001
2001 Integrated Device Technology, Inc.
DSC 5847/1
c
COMMERCIAL AND INDUSTRIAL TEMPERATURE RANGES
The IDT logo is a registered trademark of Integrated Device Technology, Inc.
FEATURES:
Eight zero delay outputs
<250ps of output to output skew
Selectable positive or negative edge synchronization
Synchronous output enable
Output frequency: 15MHz to 85MHz
3 skew grades:
IDT5V9910A-2: t
SKEW0
<250ps
IDT5V9910A-5: t
SKEW0
<500ps
IDT5V9910A-7: t
SKEW0
<750ps
3-level inputs for PLL range control
PLL bypass for DC testing
External feedback, internal loop filter
12mA balanced drive outputs
Low Jitter: <200ps peak-to-peak
Available in SOIC package
FUNCTIONAL BLOCK DIAGRAM
GND/sOE
Q
0
Q
1
REF
FS
PLL
FB
V
CCQ
/PE
Q
2
Q
3
Q
4
Q
5
Q
6
Q
7
IDT5V9910A
3.3V LOW SKEW
PLL CLOCK DRIVER
TURBOCLOCK JR.
DESCRIPTION:
The IDT5V9910A is a high fanout phase locked-loop clock driver
intended for high performance computing and data-communications appli-
cations. It has eight zero delay LVTTL outputs.
When the GND/
sOE
pin is held low, all the outputs are synchronously
enabled. However, if GND/
sOE
is held high, all the outputs except Q
2
and
Q
3
are synchronously disabled.
Furthermore, when the V
CCQ
/PE is held high, all the outputs are
synchronized with the positive edge of the REF clock input. When V
CCQ
/
PE is held low, all the outputs are synchronized with the negative edge of
REF.
The FB signal is compared with the input REF signal at the phase detector
in order to drive the VCO. Phase differences cause the VCO of the PLL to
adjust upwards or downwards accordingly.
An internal loop filter moderates the response of the VCO to the phase
detector. The loop filter transfer function has been chosen to provide mnimal
jitter (or frequency variation) while still providing accurate responses to input
frequency changes.
相關PDF資料 |
PDF描述 |
|---|---|
| IDT5V9910A-2SO | 3.3V LOW SKEW PLL CLOCK DRIVER TURBOCLOCK JR |
| IDT5V9910A-2SOI | 3.3V LOW SKEW PLL CLOCK DRIVER TURBOCLOCK JR |
| IDT5V9910A-5SO | 3.3V LOW SKEW PLL CLOCK DRIVER TURBOCLOCK JR |
| IDT5V991A | 3.3V PROGRAMMABLE SKEW PLL CLOCK DRIVER TURBOCLOCK |
| IDT5V991A-2J | 3.3V PROGRAMMABLE SKEW PLL CLOCK DRIVER TURBOCLOCK |
相關代理商/技術參數 |
參數描述 |
|---|---|
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