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參數資料
| 型號： | IDT70V24S35PFI |
| 廠商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分類： | DRAM |
| 英文描述： | COUPLING, 10X10; RoHS Compliant: NA |
| 中文描述： | 4K X 16 DUAL-PORT SRAM, 35 ns, PQFP100 |
| 封裝： | TQFP-100 |
| 文件頁數： | 1/22頁 |
| 文件大小： | 191K |
| 代理商： | IDT70V24S35PFI |
1
2000 Integrated Device Technology, Inc.
DSC-2911/8
I/O
Control
Address
Decoder
MEMORY
ARRAY
ARBITRATION
INTERRUPT
SEMAPHORE
LOGIC
Address
Decoder
I/O
Control
R/
L
L
L
A
11L
A
0L
2911 drw 01
L
L
L
I/O
8L
-I/O
15L
I/O
0L
-I/O
7L
L
L
L
R/
L
L
M/
R/
R
R
R
R
R
R
I/O
8R
-I/O
15R
I/O
0R
-I/O
7R
A
11R
A
0R
R/
R
R
(2)
R
R
R
(2)
(1,2)
(1,2)
12
12
IDT70V24S/L
HIGH-SPEED 3.3V
4K x 16 DUAL-PORT
STATIC RAM
N
True Dual-Ported memory cells which allow simultaneous
reads of the same memory location
N
High-speed access
– Commercial: 15/20/25/35/55ns (max.)
– Industrial: 20/25/35/55ns (max.)
N
Low-power operation
– IDT70V24S
Active: 400mW (typ.)
Standby: 3.3mW (typ.)
– IDT70V24L
Active: 380mW (typ.)
Standby: 660
μ
W (typ.)
N
Separate upper-byte and lower-byte control for multiplexed
bus compatibility
N
IDT70V24 easily expands data bus width to 32 bits or more
using the Master/Slave select when cascading more than
one device
N
M/
S
= V
IH
for
BUSY
output flag on Master
M/
S
= V
IL
for
BUSY
input on Slave
N
BUSY
and Interrupt Flag
N
On-chip port arbitration logic
N
Full on-chip hardware support of semaphore signaling
between ports
N
Fully asynchronous operation from either port
N
LVTTL-compatible, single 3.3V (±0.3V) power supply
N
Available in 84-pin PGA, 84-pin PLCC and 100-pin TQFP
N
Industrial temperature range (-40°C to +85°C) is available
for selected speeds
NOTES:
1. (MASTER):
BUSY
is output; (SLAVE):
BUSY
is input.
2.
BUSY
outputs and
INT
outputs are non-tri-stated push-pull.
相關PDF資料 |
PDF描述 |
|---|---|
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| IDT70V24L15GI | HIGH-SPEED 3.3V 4K x 16 DUAL-PORT STATIC RAM |
| IDT70V24L15J | HIGH-SPEED 3.3V 4K x 16 DUAL-PORT STATIC RAM |
| IDT70V24L15JI | HIGH-SPEED 3.3V 4K x 16 DUAL-PORT STATIC RAM |
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