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參數資料
| 型號： | IDT74ALVCH162373PAG |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數： | 1/6頁 |
| 文件大小： | 0K |
| 描述： | IC LATCH 16BIT TRANSP D 48-TSSOP |
| 標準包裝： | 585 |
| 系列： | 74ALVCH |
| 邏輯類型： | D 型透明鎖存器 |
| 電路： | 8:8 |
| 輸出類型： | 三態 |
| 電源電壓： | 2.3 V ~ 3.6 V |
| 獨立電路： | 2 |
| 延遲時間 - 傳輸： | 1.5ns |
| 輸出電流高，低： | 12mA，12mA |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-TFSOP（0.240"，6.10mm 寬） |
| 供應商設備封裝： | 48-TSSOP |
| 包裝： | 管件 |
| 產品目錄頁面： | 1257 (CN2011-ZH PDF) |
| 其它名稱： | 74ALVCH162373PAG 800-1552 800-1552-5 800-1552-ND |
INDUSTRIALTEMPERATURERANGE
IDT74ALVCH162373
3.3V CMOS 16-BIT TRANSPARENT D-TYPE LATCH WITH 3-STATE OUTPUTS
1
JULY 2009
INDUSTRIAL TEMPERATURE RANGE
IDT and the IDT logo are registered trademarks of Integrated Device Technology, Inc.
2009 Integrated Device Technology, Inc.
DSC-4575/6
FEATURES:
0.5 MICRON CMOS Technology
Typical tSK(o) (Output Skew) < 250ps
ESD > 2000V per MIL-STD-883, Method 3015; > 200V using
machine model (C = 200pF, R = 0)
VCC = 3.3V ± 0.3V, Normal Range
VCC = 2.7V to 3.6V, Extended Range
VCC = 2.5V ± 0.2V
CMOS power levels (0.4
μμμμμ W typ. static)
Rail-to-Rail output swing for increased noise margin
Available in SSOP and TSSOP packages
FUNCTIONAL BLOCK DIAGRAM
DESCRIPTION:
This16-bittransparentD-typelatchisbuiltusingadvanceddualmetalCMOS
technology.TheALVCH162373isparticularlysuitableforimple-mentingbuffer
registers,I/Oports,bidirectionalbusdrivers,andworkingregisters.Thisdevice
can be used as two 8-bit latches or one16-bit latch. When the latch enable (LE)
input is high, the Q outputs follow the data (D) inputs. When LE is taken low, the
Q outputs are latched at the levels set up at the D inputs.
Abufferedoutput-enable(
OE)canbeusedtoplacetheeightoutputsineither
a normal logic state (high or low logic levels) or a high-impedance state. In the
high-impedance state, the outputs neither load nor drive the bus lines signifi-
cantly.Thehigh-impedancestateandtheincreaseddriveprovidethecapability
to drive bus lines without need for interface or pullup components.
OEdoesnot
affect internal operations of the latch. Old data can be retained or new data can
be enetered while the outputs are in the high-impedance state.
TheALVCH162373hasseriesresistorsinthedeviceoutputstructurewhich
will significantly reduce line noise when used with light loads. This driver has
been designed to drive ±12mA at the designated threshold levels.
The ALVCH162373 has “bus-hold” which retains the inputs’ last state
whenevertheinputgoestoahighimpedance.Thispreventsfloatinginputsand
eliminates the need for pull-up/down resistor.
DRIVE FEATURES:
Balanced Output Drivers: ±12mA
Low switching noise
IDT74ALVCH162373
3.3V CMOS 16-BIT TRANS-
PARENT D-TYPE LATCH
WITH 3-STATE OUTPUTS
AND BUS-HOLD
1
OE
C1
1D
1
D1
47
1
LE
1
Q1
TO 7 OTHER CHANNELS
2
OE
2
D1
36
2
LE
2
Q1
TO 7 OTHER CHANNELS
1
48
2
24
25
13
C1
1D
APPLICATIONS:
3.3V high speed systems
3.3V and lower voltage computing systems
相關PDF資料 |
PDF描述 |
|---|---|
| 1776167-6 | TERM BLOCK HEADER 6POS R/A SHRD |
| 1-1546208-0 | TERM BLOCK PLUG 10POS R/A 5MM |
| VI-2NH-MU-F4 | CONVERTER MOD DC/DC 52V 200W |
| 2-796694-0 | CONN HDR VERT 20POS 3.5MM BLUE |
| VI-2NF-MU-F1 | CONVERTER MOD DC/DC 72V 200W |
相關代理商/技術參數 |
參數描述 |
|---|---|
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