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參數(shù)資料
| 型號(hào)： | ISP1161A1BM |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 總線控制器 |
| 英文描述： | Universal Serial Bus single-chip host and device controller |
| 中文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP64 |
| 封裝： | 7 X 7 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-414-1, LQFP-64 |
| 文件頁數(shù)： | 72/127頁 |
| 文件大?。?/td> | 2762K |
| 代理商： | ISP1161A1BM |
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Philips Semiconductors
ISP1161
Full-speed USB single-chip host and device controller
Product data
Rev. 01 — 3 July 2001
72 of 130
9397 750 08313
Philips Electronics N.V. 2001. All rights reserved.
13.3.4
HcRhPortStatus[1:2]
The HcRhPortStatus[1:2] register is used to control and report port events on a
per-port basis. NumberDownstreamPorts represents the number of HcRhPortStatus
registers that are implemented in hardware. The lower word is used to reflect the port
status, whereas the upper word reflects the status change bits. Some status bits are
implemented with special write behavior. If a transaction (token through handshake)
is in progress when a write to change port status occurs, the resulting port status
change must be postponed until the transaction completes. Reserved bits should
always be written logic 0.
Table 42: HcRhPortStatus[1:2] Register: bit allocation
Bit
31
Symbol
Reset
Access
Bit
23
Symbol
Reset
0
Access
Bit
15
Symbol
Reset
Access
Bit
7
Symbol
Reset
0
Access
30
29
28
27
26
25
24
reserved
00H
R/W
22
21
20
19
18
17
16
CSC
0
R/W
8
PPS
0
R/W
0
CCS
0
R/W
reserved
0
R/W
14
PRSC
0
R/W
12
OCIC
0
R/W
11
PSSC
0
R/W
10
PESC
0
R/W
9
LSDA
X
R/W
1
PES
0
R/W
0
13
reserved
N/A
N/A
6
5
4
3
2
reserved
0
R/W
PRS
0
R/W
POCI
0
R/W
PSS
0
R/W
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ISP1161BD | Full-speed Universal Serial Bus single-chip host and device controller |
| ISP1161BM | Full-speed Universal Serial Bus single-chip host and device controller |
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| ISP1181A | Full-speed Universal Serial Bus peripheral controller |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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