- 您現在的位置：買賣IC網 > PDF目錄367535 > LC4512C-35F256C PDF資料下載
參數資料
| 型號： | LC4512C-35F256C |
| 文件頁數： | 27/57頁 |
| 文件大小： | 1078K |
| 代理商： | LC4512C-35F256C |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁當前第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁
Lattice Semiconductor
ispMACH 4000V/B/C Family Data Sheet
27
Boundary Scan Waveforms and Timing Speci
fi
cations
Symbol
t
BTCP
t
BTCH
t
BTCL
t
BTSU
t
BTH
t
BRF
t
BTCO
t
BTOZ
t
BTVO
t
BTCPSU
t
BTCPH
t
BTUCO
t
BTUOZ
t
BTUOV
Parameter
Min.
40
20
20
8
10
50
—
—
—
8
10
—
—
—
Max.
—
—
—
—
—
—
10
10
10
—
—
25
25
25
Units
ns
ns
ns
ns
ns
mV/ns
ns
ns
ns
ns
ns
ns
ns
ns
TCK [BSCAN test] clock cycle
TCK [BSCAN test] pulse width high
TCK [BSCAN test] pulse width low
TCK [BSCAN test] setup time
TCK [BSCAN test] hold time
TCK [BSCAN test] rise and fall time
TAP controller falling edge of clock to valid output
TAP controller falling edge of clock to data output disable
TAP controller falling edge of clock to data output enable
BSCAN test Capture register setup time
BSCAN test Capture register hold time
BSCAN test Update reg, falling edge of clock to valid output
BSCAN test Update reg, falling edge of clock to output disable
BSCAN test Update reg, falling edge of clock to output enable
相關PDF資料 |
PDF描述 |
|---|---|
| LC4512C-35T176C | |
| LC4512C-5F256C | |
| LC4512C-5F256I | |
| LC4512C-5T176C | |
| LC4512C-5T176I | |
相關代理商/技術參數 |
參數描述 |
|---|---|
| LC4512C-35F256C1 | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:3.3V/2.5V/1.8V In-System Programmable SuperFAST High Density PLDs |
| LC4512C-35FN256C | 功能描述:CPLD - 復雜可編程邏輯器件 PROGRAMMABLE SUPER FAST HI DENSITY PLD RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| LC4512C-35FN256C1 | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:3.3V/2.5V/1.8V In-System Programmable SuperFAST High Density PLDs |
| LC4512C-35FT256C | 功能描述:CPLD - 復雜可編程邏輯器件 ispJTAG 1.8V 3.5ns 512MC 208 I/O RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| LC4512C-35FTN256C | 功能描述:CPLD - 復雜可編程邏輯器件 ispJTAG 1.8V 3.5ns 512MC 208 I/O RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
發布緊急采購，3分鐘左右您將得到回復。