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參數資料
| 型號： | MAX3624AETJ+T |
| 廠商： | Maxim Integrated Products |
| 文件頁數： | 1/12頁 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GENERATOR PREC 32TQFN |
| 產品培訓模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標準包裝： | 2,500 |
| 類型： | 時鐘發生器，扇出配送，多路復用器 |
| PLL： | 帶旁路 |
| 輸入： | LVCMOS，LVTTL |
| 輸出： | LVCMOS，LVPECL |
| 電路數： | 1 |
| 比率 - 輸入:輸出： | 2:4 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 648MHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-WFQFN 裸露焊盤 |
| 供應商設備封裝： | 32-TQFN-EP（5x5） |
| 包裝： | 帶卷 (TR) |
General Description
The MAX3624A is a low-jitter, precision clock generator
optimized for networking applications. The device inte-
grates a crystal oscillator and a phase-locked loop
(PLL) clock multiplier to generate high-frequency clock
outputs for Ethernet, Fibre Channel, SONET/SDH, and
other networking applications.
Maxim’s proprietary PLL design features ultra-low jitter
(0.36psRMS) and excellent power-supply noise rejec-
tion, minimizing design risk for network equipment.
The MAX3624A has three LVPECL outputs and one
LVCMOS output. Selectable output dividers and a
selectable feedback divider allow a range of output
frequencies.
Applications
Ethernet Networking Equipment
Fibre Channel Storage Area Network
SONET/SDH Network
Features
Crystal Oscillator Interface: 19.375MHz to 27MHz
CMOS Input: 19MHz to 40.5MHz
Output Frequencies
Ethernet: 62.5MHz, 125MHz, 156.25MHz,
312.5MHz
Fibre Channel: 106.25MHz, 159.375MHz,
212.5MHz, 318.75MHz
SONET/SDH: 77.76MHz, 155.52MHz, 311.04MHz
Low Jitter
0.14psRMS (1.875MHz to 20MHz)
0.36psRMS (12kHz to 20MHz)
Excellent Power-Supply Noise Rejection
No External Loop Filter Capacitor Required
MAX3624A
Low-Jitter, Precision Clock Generator
with Four Outputs
________________________________________________________________
Maxim Integrated Products
1
Ordering Information
CRYSTAL
OSCILLATOR
LVCMOS
DIVIDERS:
M = 16, 24, 25, 32
NA = 1, 2, 3, 4, 5, 6, 8, 10, 12
NB = 1, 2, 3, 4, 5, 6, 8, 10, 12
REF_IN
X_IN
X_OUT
0
1
0
1
PFD
FILTER
RESET
RESET LOGIC/POR
DIVIDER
M
RESET
DIVIDER
NB
DIVIDER
NA
VCO
620MHz TO 648MHz
LVCMOS
BUFFER
QA_C
QAC_OE
LVPECL
BUFFER
QA
QA_OE
QA
LVPECL
BUFFER
QB1
QB1_OE
QB1
LVPECL
BUFFER
QB0
FB_SEL[1:0]
QB0_OE
QB0
SELB[1:0]
SELA[1:0]
IN_SEL
BYPASS
MR
MAX3624A
SELA[1:0]
RESET
SELB[1:0]
FB_SEL[1:0]
BYPASS
33pF
27pF
Block Diagram
19-5005; Rev 0; 10/09
For pricing, delivery, and ordering information, please contact Maxim Direct at 1-888-629-4642,
or visit Maxim’s website at www.maxim-ic.com.
+
Denotes a lead(Pb)-free/RoHS-compliant package.
*
EP = Exposed pad.
EVALUATION
KIT
AVAILABLE
Pin Configuration and Typical Application Circuit appear at
end of data sheet.
PART
TEMP RANGE
PIN-PACKAGE
MAX3624AETJ+
-40
°C to +85°C
32 TQFN-EP*
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數 |
參數描述 |
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| MAX3625ACUG+ | 功能描述:時鐘發生器及支持產品 Low Jitter Precision w/Four Outputs RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:QFN-56 |
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