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參數資料
型號: MC10E241FN
廠商: MOTOROLA INC
元件分類: 通用總線功能
英文描述: 0.345A, 2.7-5.5V Single Hi-Side MOSFET, Fault Report, Act-High Enable 8-SOIC 0 to 85
中文描述: 10E SERIES, 8-BIT RIGHT PARALLEL IN PARALLEL OUT SHIFT REGISTER, TRUE OUTPUT, PQCC28
封裝: PLASTIC, LCC-28
文件頁數: 1/4頁
文件大?。?/td> 107K
代理商: MC10E241FN
LOGIC DIAGRAM
SEL1
CLK
MR
VEE
S-IN
D0
D1
26
27
28
2
3
4
25
24
23
22
21
20
19
18
17
16
15
14
13
12
11
5
6
7
8
9
10
SEL0
NC
D7
D6
D5
VCCO
Q7
Q6
Q5
VCC
NC
VCCO
Q4
Q3
D2
D3
D4
VCCO
Q0
Q1
Q2
Q0
Q1 – Q6
Q7
S-IN
D0
D1 – D6
D7
HOLD/LOAD
SHIFT
CLK
MR
BITS 1–6
D
D
D
Q
Q
Q
R
R
R
1
Pinout: 28-Lead PLCC
(Top View)
* All VCC and VCCO pins are tied together on the die.
SEMICONDUCTOR TECHNICAL DATA
2–1
REV 3
Motorola, Inc. 1996
7/96
The MC10E/100E241 is an 8-bit shiftable register. Unlike a standard
universal shift register such as the E141, the E241 features internal data
feedback organized so that the SHIFT control overrides the HOLD/LOAD
control. This enables the normal operations of HOLD and LOAD to be
toggled with a single control line without the need for external gating. It
also enables switching to scan mode with the single SHIFT control line.
The eight inputs D0– D7 accept parallel input data, while S-IN accepts
serial input data when in shift mode. Data is accepted a set-up time
before the positive-going edge of CLK; shifting is also accomplished on
the positive clock edge. A HIGH on the Master Reset pin (MR)
asynchronously resets all the registers to zero.
SHIFT overrides HOLD/LOAD Control
1000ps Max. CLK to Q
Asynchronous Master Reset
Pin-Compatible with E141
Extended 100E VEE Range of – 4.2V to – 5.46V
75k
Input Pulldown Resistors
PIN NAMES
Pin
Function
D0– D7
S-IN
SEL0
SEL1
CLK
MR
Q0– Q7
Parallel Date Inputs
Serial Data Inputs
SHIFT Control
HOLD/LOAD Control
Clock
Master Reset
Data Outputs
8-BIT SCANNABLE
REGISTER
FN SUFFIX
PLASTIC PACKAGE
CASE 776-02
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PDF描述
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