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參數(shù)資料
| 型號： | MC68030FE20 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | ENHANCED 32-BIT MICROPROCESSOR |
| 中文描述： | 32-BIT, 20 MHz, MICROPROCESSOR, CQFP132 |
| 封裝： | CERAMIC, QFP-132 |
| 文件頁數(shù)： | 499/602頁 |
| 文件大小： | 3863K |
| 代理商： | MC68030FE20 |
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Applications Information
12-2
MC68030 USER’S MANUAL
MOTOROLA
12.1.1 Signal Routing
Figure 12-1 shows the complete schematic for routing the signals of the MC68030 to the
MC68020 header. All signals common to both processors are directly routed to the
corresponding signal of the other processor. The signals on the MC68030 that do not have
a compatible signal on the MC68020 are either pulled up or left unconnected:
Pulled Up
No Connect
TERM
STATUS
CBACK
REFILL
CIIN
CBREQ
MMUDIS
CIOUT
12.1.2 Hardware Differences
Before enabling the on-chip caches of the MC68030, an important system feature must be
checked. Because of the MC68030 cache organization and implementation, cachable read
bus cycles are expected to transfer the entire port width of data (as indicated by the DSACKx
encoding), regardless of how many bytes are actually requested by the SIZx pins. The
MC68020 did not have this requirement, and system memory banks or peripherals may or
may not supply the amount of data required by the MC68030. If the target system does not
supply the full port width with valid data for any cachable instruction or data access the user
should either designate that area of memory as noncachable (with the MMU) or not enable
the corresponding on-chip cache(s). In some systems, modifying the target system
hardware may also be an option; frequently, the byte select logic is generated by a single
PAL, which might easily be replaced or reprogrammed to select all bytes during read cycles
from multibyte ports.
The HALT input-only signal of the MC68030 is slightly different than the bidirectional HALT
signal of the MC68020. However, this should not cause any problems beyond eliminating
an indication to the external system (e.g., lighting an LED) that the processor has halted due
to a double bus fault.
When used in a system originally designed for both an MC68020 and an MC68851, the
MC68851 may be left in the system or removed (and replaced with a jumpered header).
However, if left in the system, the MC68851 is not accessible to the programmer with the
M68000 coprocessor interface. All MMU instructions access the MC68030's on-chip MMU.
This is true even if the MC68030's MMUDIS signal is asserted. The benefit in removing the
MC68851 is that the minimum asynchronous bus cycle time to the physical bus is reduced
from four clock cycles to three.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68030 | QUad Integrated Communications Controller Users Manual |
| MC68030FE33 | ENHANCED 32-BIT MICROPROCESSOR |
| MC68040V | 32-Bit Microprocessor(32位微處理器) |
| MC68EC040 | 32-Bit Microprocessors.(32位微處理器) |
| MC68EC040V | 32-Bit Microprocessors.(32位微處理器) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| MC68030FE25 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:ENHANCED 32-BIT MICROPROCESSOR |
| MC68030FE25C | 功能描述:微處理器 - MPU 32B ON-CHIP CACHE MMU RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
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